CML输出驱动器 - 几种典型数字输出驱动器案例分析：LVDS、CMOS、CML

　　CML输出驱动器

　　转换器数字输出接口的最新趋势是使用具有电流模式逻辑（CML）输出驱动器的串行接口。通常，高分辨率（≥14位）、高速（≥200 Msps）和需要小型封装与低功耗的转换器会使用这些类型的驱动器。CML输出驱动器用在JESD204接口，这种接口目前用于最新转换器。

　　采用具有JESD204接口的CML驱动器后，转换器输出端的数据速率可达12Gbps（当前版本JESD204B规格）。此外，需要的输出引脚数也会大幅减少。时钟内置于8b/10b编码数据流，因此无需传输独立时钟信号。

　　数据输出引脚数量也得以减少，最少只需两个。由于转换器的分辨率、速度和通道数增加，数据输出引脚的数量可调整到适应所需的更高吞吐量。但是，由于CML驱动器采用的接口通常为串行接口，引脚数的增加与CMOS或LVDS相比要小得多。（CMOS或LVDS中传输的数据为并行数据，需要的引脚数多得多。）

　　表1所示为采用80Msps转换器的三种不同接口，转换器具有各种通道数和位分辨率。在CMOS和LVDS输出中，数据用作每个通道数据的同步时钟，使用CML输出时，JESD204数据传输的最大数据速率为3.2Gbps。察看该表可以发现，CML的优势十分明显，引脚数大大较少。

　　

　　表1：引脚数比较 - 80Msps ADC

　　CML驱动器用于串行数据接口，因此，所需引脚数要少得多。图3所示为用于具有JESD204接口或类似数据输出的转换器的典型CML驱动器。该图显示了CML驱动器典型架构的一般情况。图中显示了可选源端接电阻和共模电压。电路的输入可将开关驱动至电流源，电流源则将适当的逻辑值驱动至两个输出端。

　　

　　图3：典型CML输出驱动器

　　CML驱动器类似于LVDS驱动器，以恒定电流模式工作。这也使得CML驱动器在功耗方面具备一定优势。在恒定电流模式下工作需要较少的输出引脚，总功耗会降低。

　　和LVDS一样，CML也需要负载端接、单端阻抗为50？的受控阻抗传输线路，以及100？的差分阻抗。驱动器本身也可能具有如图3所示的端接，对因高带宽信号灵敏度引起的信号反射有所帮助。

　　对符合JESD204标准的转换器而言，差分和共模电平均存在不同规格，具体取决于工作速度。工作速度高达6.375Gbps，差分电平标称值为800mV，共模电平约为1.0V。

　　在高于6.375Gbps且低于12.5Gbps的速度下工作时，差分电平额定值为400mV，共模电平仍约为1.0V。随着转换器速度和分辨率增加，CML输出需要合适类型的驱动器提供必要速度，以满足各种应用中转换器的技术需求。