AD9553时钟发生器提供引脚编程模式和可定制的 SPI 编程模式,有利于 GPON、OC-48光纤网络和无线通信基础设施设备的设计。
-- ADCLK944高速时钟扇出缓冲器可降低 SONET 和无线基站系统的抖动。
北京2010年5月24日电 -- Analog Devices Inc. (NYSE: ADI),全球领先的高性能信号处理解决方案供应商和数据转换技术领先者,最近推出两款时钟产品 AD9553和 ADCLK944。这些产品用于完整时序信号链中时,可提高同步光纤网络和无线基站的性能,并降低编程和设计复杂度。
时钟发生器 AD9553适合 GPON、SONET/SDH OC-48(同步光纤网络/同步数字体系)、测试和测量、数据采集、以太网、光纤通道、T1/E1、广播视频及其它无线和有线通信应用的低成本时钟转换需求。
ADCLK944旨在改善无线基站中数据转换器的信噪比 (SNR),以及为 SONET/SDH 光纤网络提供低功耗、低抖动性能。高性能数据转换器和时钟技术是连接当今电子系统中的模拟部分与数字部分的桥梁,在这方面,越来越多的设计人员青睐 ADI 公司的产品。
AD9553时钟发生器缩短编程时间
AD9553时钟发生器提供预设的输入/输出频率比,可轻松通过引脚进行编程,而其成本只有竞争解决方案的一半左右。引脚编程模式提供一个标准输入/输出频率转换矩阵,而通过 SPI(串行外设接口)端口则可设置自定义的输入/输出频率转换。AD9553时钟发生器具有抖动清除和时钟转换两种功能。它提供各种不同的输入/输出频率组合及灵活的输出级,减少了多达两个分立锁相环 (PLL) 和多种其它分立元件,因而电路板空间得以缩小,设计复杂度得以降低,编程工作得以简化。
AD9553具有保持模式,即使没有参考输入,它也能提供输出信号。该时钟发生器还包括一个切换功能,可提供额外安全保障,如果一个 CMOS 参考失效,下游 PLL 也不会失锁。
ADCLK944时钟缓冲器提供低抖动性能
ADCLK944时钟扇出缓冲器提供业界最低的50-fs(飞秒)抖动数值,适合 LTE、MC-GSM 和其它无线网络应用中要求高性能时钟信号而又不影响高速信号转换的通信设备。这一抖动性能与每通道低功耗特性相结合,使得 ADCLK944也能有效用在基于千兆以太网 (GbE) 和 SONET/SDH 光纤网络多路复用协议的应用中。
随着 SONET/SDH 和 GbE 系统的数据速率越来越高,因而对时钟的抖动要求也非常苛刻。ADCLK944的超低抖动特性对系统抖动预算的贡献极小,从而为 SerDes (串行器/解串器)时钟设计人员提供了极大的设计灵活性。低功耗特性同样重要,因为当今系统使用含有多个通道的高密度 SONET 板。
时钟扇出缓冲器 ADCLK944提供四路工作速率最高达7 GHz 的 LVPECL 输出,同时可实现50 fs 的宽带随机均方根 (RMS) 加性抖动。其极低抖动和最大15 ps(皮秒)的输出间偏斜特性非常适合要求干净的时钟信号以供高速转换器定时的有线和无线设备,如 LTE 和多载波 GSM 通信基站等。该抖动性能也有助于满足高速 OC-192和 OC-768 SONET 线路卡的时钟分配抖动发生要求。
供货与报价
产品 样片供货 温度范围 千片订量价格 封装
AD9553 即日起 -40摄氏度 $5.10/片 5mmx5mm
至+85摄氏度 32引脚 LFCSP
ADCLK944 即日起 -40摄氏度 $6.00/片 3mmx3mm
至+85摄氏度 16引脚 LFCSP
关于 ADI 公司
Analog Devices, Inc.(简称 ADI)将创新、业绩和卓越作为企业的文化支柱,并基此成长为该技术领域最持久高速增长的企业之一。ADI 公司是业界广泛认可的数据转换和信号调理技术全球领先的供应商,拥有遍布世界各地的60,000客户,涵盖了全部类型的电子设备制造商。作为领先业界40多年的高性能模拟集成电路 (IC) 制造商,ADI 的产品广泛用于模拟信号和数字信号处理领域。公司总部设在美国马萨诸塞州诺伍德市,设计和制造基地遍布全球。ADI 公司的股票在纽约证券交易所上市,并被纳入标准普尔500指数(S&P 500 Index)。
时钟IC改善通信基础设施时序信号链的性能-- AD9553
- 时钟发生器(66942)
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2023-06-12 17:29:211226
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本文探讨了IEC 62443系列标准的基本推理和优势,这是一组旨在确保网络安全弹性的协议 保护关键基础设施和数字化工厂。这一领先的标准提供了广泛的安全层;然而,它给那些寻求认证的人带来了一些挑战。我们将解释安全IC如何为努力实现工业自动化控制系统(IACS)组件认证目标的组织提供必要的帮助。
2023-06-08 11:34:581250
FPGA主时钟约束详解 Vivado添加时序约束方法
在FPGA设计中,时序约束的设置对于电路性能和可靠性都至关重要。在上一篇的文章中,已经详细介绍了FPGA时序约束的基础知识。
2023-06-06 18:27:136195
Acrel-EIoT能源物联网平台助力 电网基础设施智能化改造和智能微电网建设
部等8部门共同印发《物联网新型基础设施建设三年行动计划(2021-2023年)》。 Acrel-EIoT能源物联网平台加速电网基础设施智能化改造和智能微电网建设,部署区域能源管理、智能计量体系、综合能源服务等典型应用系统。结合5G等通信设施的部署,搭建能
2023-06-05 09:59:22607
自动驾驶对公路基础设施有何深刻影响
自动驾驶对公路基础设施的影响主要包括物理基础设施、交通控制设备(TCD)和其它路边基础设施、运输管理和运营系统(TSMO)及其基础设施、多
式联运基础设施。
2023-06-01 14:25:570
管廊巡检机器人:推动城市基础设施安全升级的智能力量
随着城市科技现代化发展、综合管廊巡检是城市基础设施建设中重要的一环,承担着电力、通信、供水、排水等关键网络的运输和分发任务。为了保障城市运行的安全和顺畅必须不定时地对综合管廊巡检保养。然而,传统
2023-05-31 16:47:29434
基于云解决方案的基础设施
我们的团队可以帮助您选择正确的平台,并迁移您的服务器、数据库和应用程序。基于云解决方案的基础设施有助于最大的企业和增长最快的初创企业变得更加敏捷,并降低成本。
2023-05-30 09:13:44243
英特尔Agilex 7 FPGA,助力创建高速、低时延、安全的数据中心和网络基础设施
设备旨在满足数据中心基础设施、云服务提供商 (CSP)、5G 通信服务提供商 (CoSP) 当前和未来的多种需求。
2023-05-29 15:14:481010
算力基础设施关键技术
算力基础设施是算力网络的核心,以构建高效、灵活、敏捷的算力基础设施为目标,积极引入云原生、无服务器计算、异构计算、算力卸载等技术,探索算力原生、存算一体等新方向, 持续增强算力能力,释放算力价值
2023-05-24 16:38:587
无线通信基础设施中离不开的有线连接与接插件
在无线通信方便快捷的背后,是一个又一个稳定可靠的通信节点,它们编织在一起,便是全时空场景下的高速移动互联。在每一个通信节点下,光纤、路由器、电源设备等高效协同,为无线通信提供稳定可靠的支持。而今天我们要谈论的元器件则是帮助那些无线通信基础设施满足网速、EMI等指标的连接器——有线连接与接插件。
2023-05-19 10:57:58717
国常会提出“适度超前建设充电基础设施”
5月5日,国常会提出,要聚焦制约新能源汽车下乡的突出瓶颈,适度超前建设充电基础设施,创新充电基础设施建设、运营、维护模式。
2023-05-08 15:45:19747
电动车持续发展,搞好充电基础设施是关键
目前世界各地在争相将燃油汽车替换为电动汽车,预计电动汽车的普及率将迅速攀升。与目前部署的充电桩数量相比,预计电动车 (EV) 的迅速采用将会对可用的充电桩数量带来重大改变。在本文中,我们将研究电动车采用率的增加将对配电基础设施提出怎样的要求,以及在规划电动车充电基础设施时必须考虑的一些因素。
2023-05-08 10:29:03326
FPGA设计中大位宽、高时钟频率时序问题调试经验总结
时钟周期约束:用户需要将设计中的所有时钟进行约束后,综合器才能进行合理的静态时序分析。一个设计中的时钟主要分为两类:主时钟和生成时钟。主时钟包括由全局时钟引脚接入的时钟、高速收发器的输出时钟。
2023-05-06 09:31:341253
更智能的基础设施是更安全、更顺畅的移动性的关键
车辆到基础设施 (V2I) 是一种通信模型,允许车辆与支持一个国家高速公路系统的组件共享信息,例如交通信号灯、车道标记、路灯、标牌、架空 RFID 阅读器、摄像头和停车计时器。几乎任何物体,从建筑物到灯柱再到住宅区,都可以配备此功能。
2023-05-04 09:52:55337
如何调整LVDS时钟频率和时序?
我正在尝试使用 i.MX8MP EVK 输出 LVDS,但我无法调整 LVDS 输出时钟频率和时序。我需要修改哪些源码,应该怎么修改?需要的时序参数如下:像素时钟 = 54.13 MHz有效分辨率
2023-04-18 09:46:58
MC33772C使用菊花链没有唤醒是为什么?
BMS 使用 ADI 的 LTC6820 连接到 MC33772C,具有菊花链唤醒功能,但没有唤醒功能。MC33772C上电后进入INIT,等待60S后进入IDLE状态。 通信正常,唤醒时序为6820的CS下拉、上拉、下拉、上拉操作,但没有唤醒。关于在菊花链唤醒中寻找什么的任何建议?
2023-04-17 07:49:25
单位宽信号如何跨时钟域
单位宽(Single bit)信号即该信号的位宽为1,通常控制信号居多。对于此类信号,如需跨时钟域可直接使用xpm_cdc_single
2023-04-13 09:11:37911
光伏与储能核心基础设施中的连接器
形式。储能市场在过去几年里的火爆程度大家也项目共睹。 “光伏+储能”模式里,光伏逆变器和储能变流器是两大核心基础设施。经由这两大核心基础设施如何把大量组件的电量汇集在一起,都依赖于电缆和连接器。光伏连接器和储
2023-04-06 00:32:002092
时钟抖动和时钟偏斜讲解
系统时序设计中对时钟信号的要求是非常严格的,因为我们所有的时序计算都是以恒定的时钟信号为基准。但实际中时钟信号往往不可能总是那么完美,会出现抖动(Jitter)和偏移(Skew)问题。
2023-04-04 09:20:561633
信号完整性仿真三个重点:信号质量、串扰和时序
信号完整性仿真重点分析有关高速信号的3个主要问题:信号质量、串扰和时序。对于信号质量,目标是获取具有明确的边缘,且没有过度过冲和下冲的信号。
2023-04-03 10:40:07887
时序约束的相关知识(二)
设置 Input-to-Reg 时序路径的约束时,不仅需要创建时钟模型,还需要设置输入延时 (input delay)。设置 input delay 时,需要假设输入 port 信号是与时钟
2023-03-31 16:39:141044
跨时钟域处理方法(一)
理论上讲,快时钟域的信号总会采集到慢时钟域传输来的信号,如果存在异步可能会导致出现时序问题,所以需要进行同步处理。此类同步处理相对简单,一般采用为延迟打拍法,或延迟采样法。
2023-03-28 13:50:291386
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