在对XilinxFPGA设计进行功耗评估时,都要用到XPE(XilinxPower Estimator)。从2015.4版本开始,针对UltraScale/UltraScale+器件,Fanout被RoutingComplexity所取代,以获取更为精确的的评估结果,如下图所示。
在老版本的XPE中,对于动态功耗,需要准确填入扇出以估计布线资源的使用率。这里有一个假设:扇出越大,消耗的布线资源就越多。这会带来一个问题:如果一个设计中的短线或长线用得比较多,那么评估的布线模型就与实际布线结果不同。为了补偿这个差异,从2015.4版本开始,用物理实现的Routing Complexity取代了逻辑定义的扇出。 那么Routing Complexity是什么含义呢?
RoutingComplexity实际反映的是每个logic cell使用的布线资源的平均数目。此值越大说明布线拥塞程度越高。典型值为8(也是默认值),可满足大部分设计的需求。同时,应将此值控制在5~15之间,过高(超过15)或过低(小于5)都不合适。例如,对于一个全局复位信号,其扇出非常大,导致RoutingComplexity可能超过20,毕竟这个net需要到达芯片几乎所有的逻辑单元。但这种情况是比较罕见的。另一方面,某个net扇出为1,并且源端和目的端在同一个SLICE,那么Routing Complexity就会非常低。这种情况也是非常罕见的。 在填写RoutingComplexity时,需要考虑如下几个因素:扇出、芯片规模、设计的资源利用率、综合或布局布线跟Floorplan相关的选项。 另一方面,如果我们已经有一个现成的设计,并完成了布局布线,那么可以在Vivado下利用命令report_power生成.xpe,并将该文件导入到XPE中,相应的Routing Complexity的值就会被反标到XPE里,这样可获得较为精确的RoutingComplexity。
审核编辑 :李倩
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原文标题:XPE中的routing complexity怎么填?
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