(一)单bit信号同步器
cdc_s信号必须做到glitch free,也就是我们通常说的寄存输出;
int_s信号链路禁止组合逻辑,其本质也是杜绝glitch的出现。
上面的论述是基于电平方式,那么怎么确保脉冲能被采到呢?源时钟域的时钟慢的话,快采慢OK,否则慢采快就有如下漏采的问题。
(二)DMUX同步器
两级寄存器(先进工艺要求三级)的同步器通常用于控制信号的异步处理,但是data bus的异步处理呢?我们可以采用DMUX结构。
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原文标题:解析异步电路设计
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