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DataBusShift——数据移位下游说了算

Spinal FPGA 来源:Spinal FPGA 作者:Spinal FPGA 2022-12-05 10:36 次阅读

编 者 按

在逻辑设计里,比如需要分层解析数据的场景,往往当前时钟能消耗处理多少数据依赖于数据的实时解析,下一拍将移出已解析过的数据。本文就这种场景来做逻辑上的实现及优化。

需求分析

在逻辑设计中,我们不妨将系统数据总线定义如下:

出了数据握手交互所需的vaild/ready外,数据总线一般包含data,empry(表示数据最后一拍的空闲字节数),sop,eop。在一些需要数据分层解析移位的场景,我们所需要的整体的模块可定义如下:

port_in:数据输入端口

port_out:数据输出端口

shift_num:指定当前时钟周期port_out所消耗的字节数

整体的需求无非是每个时钟周期port_out每消耗多少数据,下一拍port_out就要补齐输出多少数据,由于数据总线位宽往往固定,则可能需要跨时钟周期移位。正如下面的时序:

审核编辑:汤梓红

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原文标题:DataBusShift——数据移位下游说了算

文章出处:【微信号:Spinal FPGA,微信公众号:Spinal FPGA】欢迎添加关注!文章转载请注明出处。

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