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WCH RISC-V-CH307V(优点熟悉版)

云深之无迹 来源:云深之无迹 2023-01-16 14:11 次阅读

拿到了WCH的一块板子:

f138f7c2-94ec-11ed-bfe3-dac502259ad0.jpg

方方正正的盒子,展会上面还看到他家的这个芯片来着

f164d07c-94ec-11ed-bfe3-dac502259ad0.jpg

堆料很足的

f1934b8c-94ec-11ed-bfe3-dac502259ad0.png

就是这样

emmmm,看过一些RISC-V的书,也经常看它的新闻,ARM一家独大的场面,是所有人都不愿意看到的局面。所以大家都押注这个开源的东西,以前淘宝看见卖四五十块钱的板子,我后来想这么多板子了,就没有买。这次终于拿到一个板子,略微深入的探索一下。

不过我可以说,10年前是51的天下,五年前是ARM的天下,但是我说不准后5年的局面,可能是RISC-V,ARM平分天下的格局吗?有可能的,所以我这里也在赌一个未来,现在学是投资未来。

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嗯,上面的内容摘自:

f1fe7556-94ec-11ed-bfe3-dac502259ad0.png

这个是小册子,想看可以找我

首先RISC-V是一种开源的架构,也是年轻具有活力的CPU设计,在Intel,51,ARM,PowerC的前辈加持下,它就像被基因工具改造的孩童一般。出生就有了无限可能。

害,学就对了。

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Logo

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就单看这几个赞助的就知道了

f2651662-94ec-11ed-bfe3-dac502259ad0.png

全家福

f299cf06-94ec-11ed-bfe3-dac502259ad0.png

学有余力推荐这个,1600+页,很攒劲儿,搞懂去中科院没啥难度吧~

继续聊板子,具体的外设就不看了,不重要,直接去数据手册看。

CH32V305/7系列是基于32位RISC-V设计的互联型微控制器,配备了硬件堆栈区、快速中断入口,在标准RISC-V基础上大大提高了中断响应速度。加入单精度浮点指令集,扩充堆栈区,具有更高的运算性能。扩展串口UART数量到8组,电机定时器到4组。提供USB2.0高速接口(480Mbps)并内置了PHY收发器以太网MAC升级到千兆并集成了10M-PHY模块。

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怎么说呢,该有的都有,而且CH32,难免让人有点感觉是致敬STM32

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优点是全中文,资料较为齐全

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都可以在Gituhb上面找到,官网也行

f35cfe7c-94ec-11ed-bfe3-dac502259ad0.png

资料齐全

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代码一会儿说

f3b45ec4-94ec-11ed-bfe3-dac502259ad0.png

自带的IDE,还可以选择RTOS

f3e0ae20-94ec-11ed-bfe3-dac502259ad0.png

但是寄存器这些是ARM和RISC-V混合在一起一个文件的

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ARM的架构

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WOC,一模一样的

系统中设有:Flash 访问预取机制用以加快代码执行速度;通用 DMA 控制器用以减轻 CPU 负担、提高效率;时钟树分级管理用以降低了外设总的运行功耗,同时还兼有数据保护机制,时钟安全系统保护机制等措施来增加系统稳定性。 l 指令总线(I-Code)将内核和 FLASH 指令接口相连,预取指在此总线上完成。 l 数据总线(D-Code)将内核和 FLASH 数据接口相连,用于常量加载和调试。 l 系统总线将内核和总线矩阵相连,用于协调内核、DMA、SRAM 和外设的访问。 l DMA 总线负责 DMA 的 AHB 主控接口与总线矩阵相连,该总线访问对象是 FLASH 数据、SRAM 和外设。 l 总线矩阵负责的是系统总线、数据总线、DMA 总线、SRAM 和 AHB/APB 桥之间的访问协调。 l AHB/APB 桥,为 AHB 总线和两个 APB 总线提供同步连接。不同的外设挂在不同的 APB 总线下,可以按实际需求配置不同总线时钟,优化性能。

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ARM的和RISC—V的储存空间,它们都在一个 4GB 的线性空间寻址。系统存储以小端格式存放数据,即低字节存放在低地址,高字节存放在高地址。 Emmmm,看STM32的感觉,一模一样的好吧。。。总之看下来:

架构中将内核、仲裁单元、DMA 模块、SRAM 存储等部分通过多组总线实现交互。设计中集成通用 DMA 控制器以减轻 CPU 负担、提高访问效率,应用多级时钟管理机制降低了外设的运行功耗,同时兼有数据保护机制,时钟自动切换保护等措施增加了系统稳定性。

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这个定时器和STM32很一样

单纯的说数据手册没有意思,看看代码吧~

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这个RISC-V的代码没有STM32库那么多

f4ec8668-94ec-11ed-bfe3-dac502259ad0.png

主要要操作的外设都放好了,直接调用

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我简单的看一个GPIO

f55ba5e8-94ec-11ed-bfe3-dac502259ad0.png

里面文件很少

f5779672-94ec-11ed-bfe3-dac502259ad0.png

PA0输出

f5a11c18-94ec-11ed-bfe3-dac502259ad0.png

片子有3个串口,可以这样的自定义

f5c138e0-94ec-11ed-bfe3-dac502259ad0.png

内部是三个关于延时的函数

f5e2dfae-94ec-11ed-bfe3-dac502259ad0.png

延时的初始化

f6012446-94ec-11ed-bfe3-dac502259ad0.png

时钟源是HSE,晶振来的

f623e878-94ec-11ed-bfe3-dac502259ad0.png

然后这个是时钟核心频率

f6424264-94ec-11ed-bfe3-dac502259ad0.png

将这个位置的地址强转,这个是RISC-V内核的地址转换

f65a7f1e-94ec-11ed-bfe3-dac502259ad0.png

哦,原来是计数器

f6800e3c-94ec-11ed-bfe3-dac502259ad0.png

要不是平时老看数据手册,估计现在就晕了

f6a6bab4-94ec-11ed-bfe3-dac502259ad0.png

这个就是上面计数器的封装了

f6c8118c-94ec-11ed-bfe3-dac502259ad0.png

这个之后研究吧,就是使用的计时器实现的延时函数

f6e702ae-94ec-11ed-bfe3-dac502259ad0.png

串口打印的函数

f715e4a2-94ec-11ed-bfe3-dac502259ad0.png

直接GPIO和串口外设,和STM32一模一样

f7354f40-94ec-11ed-bfe3-dac502259ad0.png

不过比STM32少点

f757e294-94ec-11ed-bfe3-dac502259ad0.png

速度

f78080be-94ec-11ed-bfe3-dac502259ad0.png

引脚模式

f7a7b332-94ec-11ed-bfe3-dac502259ad0.png

这个是串口的功能,最后一个是流控

f7c6ace2-94ec-11ed-bfe3-dac502259ad0.png

这里有三个串口,提前放好

f7e59026-94ec-11ed-bfe3-dac502259ad0.png

这里是判断要用第一个串口

f80997c8-94ec-11ed-bfe3-dac502259ad0.png

开启的是APB的时钟:Enables or disables the High Speed APB (APB2) peripheral clock.

f82906e4-94ec-11ed-bfe3-dac502259ad0.png

是不是很眼熟

f84655aa-94ec-11ed-bfe3-dac502259ad0.png

RCC的封装,一模一样的

f8666d04-94ec-11ed-bfe3-dac502259ad0.png

时钟控制器

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都有的

f8ab4078-94ec-11ed-bfe3-dac502259ad0.png

IO脚

f8e2c714-94ec-11ed-bfe3-dac502259ad0.png

上膛,一模一样

f9052d90-94ec-11ed-bfe3-dac502259ad0.png

串口的初始化

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最后的模式是发送

f951ce20-94ec-11ed-bfe3-dac502259ad0.png

很简单的

f9750a16-94ec-11ed-bfe3-dac502259ad0.png

GPIO翻转,初始化结构体,开启时钟,把GPIO的参数装载,然后开启。

f99d28c0-94ec-11ed-bfe3-dac502259ad0.png

这个主函数明天写,实在太胃疼了,要睡觉了

审核编辑 :李倩

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原文标题:WCH RISC-V-CH307V(优点熟悉版)

文章出处:【微信号:TT1827652464,微信公众号:云深之无迹】欢迎添加关注!文章转载请注明出处。

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