CATIA软件的前世今生
CATIA软件时达索公司的产品，源于60年代的航天行业，源于理论计算流体力学和应力分析以及对成型零件进行数控加工等关键需求的出现，由此，电脑和图形终端应运而生。
早在1967年，达索公司开始了定义飞机模型软件的研发工作。
到1981年初，达索公司决定通过CATIA建立了一项新的业务，创立了达索系统，将CAD/CAM研发人员划分至达索系统公司。成立之初，公司由15名员工组成，主要负责为各行业开发CATIA，并与IBM联合在全球销售CATIA软件同时提供技术支持。
1981年末，达索系统公司和IBM公司共同发布CATIA 1.0版本。
至此，达索CATIA系统开始向航天和汽车行业销售CATIA软件，其中包括了法国达索航空公司、美国格鲁门航空航天公司、法国斯奈克玛公司（喷气式发动机制造商）、德国戴姆勒-奔驰汽车公司、德国宝马汽车公司、日本本田 汽车公司等，国内包括沈飞、成飞、西飞等。
1991年，达索系统公司成立了10年，员工从开始的15人增长达到1000人，并在美国和日本分部设立了子公司，客户达到2500人，其中汽车行业客户占40%，航天业占30%，其他行业占30%。更关键的是，CATIA V3版本可建立数字模型中的第4版本从任务驱动转向流程驱动，并开始关注细分市场，从原来的汽车行业和航天行业，开始面向更广阔的市场，能够满足包括汽车、航空航天、制造装配、消费品、轮船、工厂等行业的设计需求。
1995年，CATIA第4版的操作系统具备了硬件无关性，使软硬件隔离，软件的可升级 性、可移植性、可重复利用性大大提高从而大大降低了软件的开发成本。也是在这一年，CATIA公司发展壮大，客户达到了8000家。
1998年，CATIA解决方案第5版诞生，CATIA V5是全新开发的全新版本，应用于UNIX和Windows两种平台，支持PLM架构。
......
众联亿诚是达索CATIA软件的正版授权代理商，如果您对CATIA软件还有任何问题，欢迎随时联系众联亿诚，我们为您提供CATIA软件的购买、培训、考试认证、认证培训、二次开发等服务。
审核编辑黄宇
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接下来我们就要考虑如何消除冒险 ，消除冒险的方式有一下几种：
1、利用冗余项消除毛刺
函数式和真值表所描述的是静态逻辑，而竞争则是从一种 稳态到另一种稳态的过程。因此竞争是动态过程，它发生在输入变量变化时。此时，修改卡诺图，增加多余项，在卡诺图的两圆相切处增加一个圆，可以消除逻辑冒险。但该法对于计数器型产生的毛刺是无法消除的。
2、采用格雷码
我们可以通过改变设计，破坏毛刺产生的条件，来减少毛刺的发生。例如，在数字电路设计中，常常采用格雷码计数器取代普通的二进制计数器，这是因为格雷码计数器的输出每次只有一位跳变 消除了竞争冒险的发生条件，避免了毛刺的产生。
3、采样法
由于冒险出现在变量发生变化的时刻，如果待信号稳定之后加入取样脉冲，那么就只有在取样脉冲作用期间输出的信号才能有效。这样可以避免产生的毛刺影响输出波形。 一般说来，冒险出现在信号发生电平转换的时刻，也就是说在输出信号的建立时间内会发生冒险，而在输出信号 的保持时间内是不会有毛刺信号出现的。如果在输出信号的保持时间内对其进行采样，就可以消除毛刺信号的影响。
4、吸收法
增加输出滤波，在输出端接上小电容Ｃ可以滤除毛刺 。但输出波形的前后沿将变坏，在对波形要求较严格时，应再加整形电路，该方法不宜在中间级使用。
5、延迟办法
因为毛刺最终是由于延迟造成的，所以可以找出产生延迟的支路。对于相对延迟小的支路，加上毛刺宽度 的延迟可以消除毛刺。 还可以用高频时钟来驱动一移位寄存器，待延时信号作数据输入，按所需延时正确设置移位寄存器的级数 ，移位寄存器的输出即为延时后的信号。
当然最好的就是，在设计之初，就对竞争冒险进行规避，具体规避方法有：
1、在设计中每一个模块中只用一个时钟，避免使用多时钟设计，同时避免使用主时钟分频后的二次时钟作为时序器件的时钟输入， 因为时钟偏斜会比较大 。
2、设计译码逻辑电路时必须十分小心，因为译码器和比较器本身会产生尖峰，容易产生毛刺，把译码器或比较器的输出直接连到时钟输入端或异步清除端，会造成严重的后果。
3、在设计中 应该尽量避免隐含 RS 触发器的出现。一般要控制输出被直接反馈到输入端，采用反馈环路会出现隐含 RS 触发器，其对输入尖峰和假信号很敏感，输入端有任何变化都有可能使输出值立刻改变，此时易造成毛刺的产生，导致时序的严重混乱。
4、在设计电路时 要用寄存器和触发器设计电路，尽量不要用锁存器，因它对输入信号的毛刺太敏感。如果坚持用锁存器设计必须保证输入信号绝对没有毛刺，且满足保持时间。
5、在设计中充分利用资源 ，因为 大部分 FPGA 器件都为时钟、复位、预置等信号提供特殊的全局布线资源，要充分利用这些资源。
6、在设计中 不论是控制信号还是地址总线信号、数据总线信号，都要采用另外的寄存器，以使内部歪斜的数据变成同步数据。
7、在设计中 应该尽 量避免使用延迟线，因它对工艺过程的变化极为敏感，会大大降低电路的稳定性和可靠性，并将为测试带来麻烦。
8、在设计中 对所有模块的输入时钟、输入信号、输出信号都用Ｄ触发器或寄存器进行同步处理，即输出信号直接来自触发器或寄存器的输出端。这样可以消除尖峰和毛刺信号。
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