Allegro和 Sigrity 软件最新发布了一系列的产品更新(SPB17.4 QIR4 release)。我们将通过实例讲解、视频演示让您深入了解 Allegro PCB Editor、Allegro System Capture、Allegro Package Designer Plus(本期内容)、Sigrity Aurora、Sigrity SystemSI(本期内容)、Sigrity SystemPI等产品的新功能及用法,助力提升设计质量和设计效率。
Cadence Sigrity SystemSI 的模块化设计允许用户方便地搭建任意拓扑,支持最新的 IBIS/Spice/ TouchStone/IBIS-AMI 模型。
Sigrity SystemSI 可以对高速串行通道进行眼图和误码率分析,对系统中的任意参数进行扫描,得到最优化配置,并且集成了 PCI-E、SATA 等工业标准,直接对仿真结果进行判别。
Sigrity SystemSI 可以对整个 DDR 系统进行准确的 SSN 分析,集成 JEDEC 标准,自动为用户量测 SI 参数,并以此为基础,进行自动化时序分析。
Sigrity SystemSI
系统信号仿真亮点——
1# 支持MIPI-C仿真与合规检查分析
Wbench_SPB17.4_QIR4 更新之后,Sigrity SystemSI 可以支持 MIPI-C 仿真与合规检查分析,支持信号链路拓扑互连及仿真。
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实例讲解 · 视频版
建议在WIFI环境下观看,并注意调整音量
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实例讲解 · 图文版
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使用 MIPI-C PHY 合规包可以生成 MIPI-C 信号互连模型,CPhyTx 是合规包信号发送端口,CPhyRx 是合规包信号接收端口,TP1、TP2 是合规信号观测点。
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利用框架模板生成的 TX 发送信号 IBIS 模型数据及路径。
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利用框架模板生成的 TX 发送信号 IBIS 模型数据。
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利用框架模板生成的 RX 接收信号 IBIS 模型数据及路径。
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利用框架模板生成的 RX 接收信号 IBIS 模型数据。
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MIPI-C信号互连通道仿真参数设置。
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MIPI-C 发送模型参数设置及激励数据的设置。
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MIPI-C 接收模型参数设置及抖动参数设置,激励码数据设置。
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MIPI-C 合规包分析检查项选择,眼图分析和差损数据分析。
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MIPI-C 合规包分析仿真结果。
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MIPI-C 合规包分析仿真结果。
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MIPI-C 合规包分析仿真结果,通道的模型数据。
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合规包接收眼图信号分析。
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合规包通道插损结果。
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MIPI-C 合规检查的结果及波形数据。
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