数字PLL中会利用到JK触发器,JK触发器的J=1,K=1时,JK触发器输出取反,即二分频。
当有进位脉冲信号CARRY时,则在输出的二分频信号中插入半个脉冲,以提高输出信号的频率;
当有借位脉冲信号BORROW时,则在输出的二分频信号中减去半个脉冲,以降低输出信号的频率。
DRC、LVS run一下:
最近准备集成64位双核RISCV处理器、LPDDR4、MIPI、ISP、VPU,开发一款多媒体SoC芯片,TSMC12nm工艺。数据涉密,架构开放讨论。
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原文标题:数字PLL设计实战(一)
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