0
  • 聊天消息
  • 系统消息
  • 评论与回复
登录后你可以
  • 下载海量资料
  • 学习在线课程
  • 观看技术视频
  • 写文章/发帖/加入社区
会员中心
创作中心

完善资料让更多小伙伴认识你,还能领取20积分哦,立即完善>

3天内不再提示

【华秋干货铺】一文轻松搞定PCB叠层和阻抗设计

华秋电子 2023-07-31 10:18 次阅读

为了减少在高速信号传输过程中的反射现象,必须在信号源、接收端以及传输线上保持阻抗的匹配。单端信号线的具体阻抗取决于它的线宽尺寸以及与参考平面之间的相对位置。特定阻抗要求的差分对间的线宽/线距则取决于选择的PCB叠层结构。

由于最小线宽和最小线距是取决于PCB类型以及成本要求,受此限制,选择的PCB叠层结构必须能实现板上的所有阻抗需求,包括内层和外层、单端和差分线等。

PCB叠层设计

层的定义设计原则

1、主芯片相临层为地平面,提供器件面布线参考平面;

2、所有信号层尽可能与地平面相邻;

3、尽量避免两信号层直接相邻;

4、主电源尽可能与其对应地相邻;

5、原则上应该采用对称结构设计,对称的含义包括:介质层厚度及种类、铜箔厚度、图形分布类型(大铜箔层、线路层)的对称。

PCB的层定义推荐方案

具体的PCB层设置时,要对以上原则进行灵活掌握,根据实际的需求,确定层的排布,切忌生搬硬套。以下给出常见的层排布推荐方案,供参考。在层设置时,若有相邻布线层,可通过增大相邻布线层的间距,来降低层间串扰。对于跨分割的情况,确保关键信号必须有相对完整的参考地平面或提供必要的桥接措施。

本文以RK3588方案的PCB设计为例,其10层1阶,10层2阶,8层通孔等PCB叠层结构的相关介绍,给客户在叠层结构的选择和评估上提供帮助。如果选择其他类型的叠层结构,请根据PCB厂商给出的规格,重新计算阻抗。

本文使用华秋DFM软件的阻抗计算功能,为大家展开相关叠层和阻抗设计的案例讲解。这是一款国内免费的PCB可制造性和PCBA装配分析软件,帮助设计工程师在生产前检查出可制造性问题,且能够满足工程师需要的多种使用场景

华秋DFM软件下载地址(复制到电脑浏览器打开):

https://dfm.elecfans.com/uploads/software/promoter/hqdfm_DFMGZH.zip

8层通孔板1.6mm厚度叠层设计

在8层通孔板叠层设计中,顶层信号L1的参考平面为L2,底层信号L8的参考平面为L7。建议层叠为TOP-Gnd-Signal-Power-Gnd-Signal-Gnd-Bottom,基铜厚度建议全部采用 1oZ,厚度为1.6mm,其叠层设计如下图所示。

7499279d664041fd96d98d1f3d46b8bc~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=J6qkioU98RebUa%2BF06IZg7tUCrc%3D

8层通孔板1.6mm厚度阻抗设计

外层单端50欧姆阻抗设计

使用华秋DFM工具,选择外层单端阻抗模型,输入对应参数,计算出对应线宽为3.8mil,L1与L8层是对称设计,故L1层与L8层50欧姆单端走线为3.8mil,如下图所示。

fad4cdf0ae364443bae09046de9b6708~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=fteThiQukMBU%2BMkwf0NHWB0%2Be3w%3D

外层差分100欧姆阻抗设计

使用华秋DFM工具,选择外层单端阻抗模型,输入对应参数,计算出对应线宽/间距为3.3/7.7mil,L1与L8层是对称设计,故L1层与L8层100欧姆差分走线为3.3/7.7mil,如下图所示。

d3379ca9abd04e76a2a448d72ba16b56~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=u73q2PMEipVqaV389CGi7nXN2kU%3D

内层单端50欧姆阻抗设计

使用华秋DFM工具,选择外层单端阻抗模型,输入对应参数,计算出对应线宽为4.2mil,L3与L6层是对称设计,故L3层与L6层50欧姆单端走线为4.2mil,如下图所示。

9726f0e935aa4ae280317442ec0571b1~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=zWbFnw1kETqth0x31x3BUbD3990%3D

内层差分100欧姆阻抗设计

使用华秋DFM工具,选择外层单端阻抗模型,输入对应参数,计算出对应线宽/间距为3.3/7.7mil,L3与L6层是对称设计,故L3层与L6层100欧姆差分走线为3.3/7.7mil,如下图所示。

241324952a9449ffaf40f8f1f1a0b4fa~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=UWHElhhgistBLjGpe3HfPsFyYdU%3D

总体阻抗走线线宽

321f0843a02648d89b066dca450dafa5~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=I7kfuMmKNbgA6Q4a0Dg2iux4p5o%3D

8层通孔板1.2mm厚度叠层设计

在8层通孔板叠层设计中,顶层信号L1的参考平面为L2,底层信号L8的参考平面为L7。建议层叠为
TOP-Gnd-Signal-Power-Gnd-Signal-Gnd-Bottom,基铜厚度建议全部采用 1oZ,厚度为1.2mm,详细的叠层设计如下表所示。

d26e5daa606a41e886ee1761f02fb7ed~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=DPK3YnuzuI5kbfpCDSUzgQwW4Js%3D

8层通孔板1.2mm厚度阻抗设计

按照叠层设计参数,使用华秋DFM软件进行阻抗计算,计算方法与上述8层1.6MM通孔一致,不一一截图,计算出的阻抗线宽线距如下表所示。

c1483361cdd94253b0fbb9253d1a5864~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=uB2gE3J9O7uQRTC%2BnwWXRjGJrgE%3D

8层通孔板1.0mm厚度叠层设计

在8层通孔板叠层设计中,顶层信号L1的参考平面为L2,底层信号L8的参考平面为L7。建议层叠为
TOP-Gnd-Signal-Power-Gnd-Signal-Gnd-Bottom,基铜厚度建议全部采用 1oZ,厚度为1.0mm,详细的叠层设计如下表所示。

d15ea0f31e0c431fa0755bc0fae82692~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=2aaHY5uk95iyRW0ZS3EdsDzpQ%2Bo%3D

8层通孔板1.0mm厚度阻抗设计

按照叠层设计参数,使用华秋DFM软件进行阻抗计算,计算方法与上述8层1.6MM通孔一致,不一一截图,计算出的阻抗线宽线距如下表所示。

547de94d7ab34f789ed5621efa6565ad~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=rOJxwoZiSFdXlNAkCQ4xrq0sOHY%3D

10层1阶HDI板1.6mm厚度叠层设计

在10层1阶板叠层设计中,顶层信号L1的参考平面为L2,底层信号L10的参考平面为L9。建议层叠为
TOP-Signal/Gnd-Gnd/Power-Signal-Gnd/Power-Gnd/Power-Gnd/Power-Signal-Gnd-Bottom,其中L1,L2,L9,L10,建议采用1oZ,其它内层采用HoZ。如下图所示为1.6mm板厚的参考叠层。

6b2b330addab4008b85c346efffb3681~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=U0Z%2FlVF0ZnOy8VsBy3RPwdBJxSg%3D

10层1阶HDI板1.6mm厚度阻抗设计

按照叠层设计参数,使用华秋dfm软件进行阻抗计算,计算方法与上述8层通孔一致,不一一截图,计算出的单端阻抗线宽线距、差分阻抗线宽线距如下图所示。

2cd8400d27d6493382a90420b48bd6f0~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=Z%2BM5hP%2FNuIZderdgSibNSBJmZT4%3D

b88e362578f246d39697e3dc06ec9794~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=M%2FVhEa7ysPhKAm3PB6ukisVvDAk%3D

10层2阶HDI板1.6mm厚度叠层设计

在10层2阶板叠层设计中,顶层信号L1的参考平面为L2,底层信号L10的参考平面为L9。建议层叠为
TOP-Gnd-Signal-Gnd-Power-Signal/Pow -Gnd-Signal-Gnd-Bottom,其中L1,L2,L3,L8,L9,L10,建议采用1oZ,其它内层采用HoZ。下图为1.6mm板厚的参考叠层。

1bb370c651224de7b2499b43f357dba1~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=UoZ0R7g7J2uNuUbL8VwvZY8JYGQ%3D

10层2阶HDI板1.6mm厚度阻抗设计

按照叠层设计参数,使用华秋dfm软件进行阻抗计算,计算方法与上述8层通孔一致,不一一截图,计算出的单端阻抗线宽线距、差分阻抗线宽线距如下图所示。

09f1ca7c873e4a0aa7bcb0cec8214141~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=q8IotOMc4fXH7Ai5Tf6hPHR0nSk%3D

729e72afa99640eaac2f834c3c419fc6~noop.image?_iz=58558&from=article.pc_detail&x-expires=1691374391&x-signature=gxlL3A50BBdNgsg36c0WgX1Xqco%3D

华秋DFM软件下载地址(复制到电脑浏览器打开):

https://dfm.elecfans.com/uploads/software/promoter/hqdfm_DFMGZH.zip

声明:本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人,不代表电子发烧友网立场。文章及其配图仅供工程师学习之用,如有内容侵权或者其他违规问题,请联系本站处理。 举报投诉
  • pcb
    pcb
    +关注

    关注

    4319

    文章

    23080

    浏览量

    397466
  • 阻抗
    +关注

    关注

    17

    文章

    957

    浏览量

    45912
  • PCB设计
    +关注

    关注

    394

    文章

    4683

    浏览量

    85540
  • DFM
    DFM
    +关注

    关注

    8

    文章

    463

    浏览量

    28191
收藏 人收藏

    评论

    相关推荐

    干货分享】秋干货 | PCB铜的DFM(可制造性)设计要点

    PCB设计铜是电路板设计的个非常重要的环节。   什么是PCB铜,就是将PCB上无布线区域
    的头像 发表于 12-01 08:15 1916次阅读

    轻松搞定PCB阻抗设计

    为了减少在高速信号传输过程中的反射现象,必须在信号源、接收端以及传输线上保持阻抗的匹配。单端信号线的具体阻抗取决于它的线宽尺寸以及与参考平面之间的相对位置。特定阻抗要求的差分对间的线宽/线距则取决于选择的
    的头像 发表于 07-12 09:10 2009次阅读
    <b class='flag-5'>一</b><b class='flag-5'>文</b><b class='flag-5'>轻松</b><b class='flag-5'>搞定</b><b class='flag-5'>PCB</b><b class='flag-5'>叠</b><b class='flag-5'>层</b>和<b class='flag-5'>阻抗</b>设计

    PCB设计

    了信号线的特征阻抗,也可有效地减少串扰。所以,对于某些高端的高速电路设计,已经明确规定定要使用6(或以上的)的方案,如Intel对P
    发表于 05-17 22:04

    PCB设计及阻抗计算

    PCB设计及阻抗计算
    发表于 06-02 17:13

    PCB设计及阻抗计算

    PCB设计及阻抗计算
    发表于 09-28 15:13

    秋干货 | PCB阻抗计算的可制造性设计

    则与特性阻抗相同。 共面阻抗 阻抗线距导体的间距与阻抗成正比,间距越大,阻抗越大,其它影响因素则与特性
    发表于 04-28 11:12

    秋干货PCB布线技巧升级:高速信号篇

    5.4Gbps,那么不用挖BGA区域的参考,如下图所示。 02 避免玻纤编织效应 PCB基板是由玻璃纤维和环氧树脂填充压合而成。玻璃纤维的介电常数大约是6,树脂的介电常数般不到3。在路径长度和信号速度
    发表于 08-03 18:18

    秋干货】软硬结合板的阻抗计算,你会吗?

    ,可以在参数配置里面填写修改,保存即可。 计算阻抗匹配介质厚度压合图 硬板图 1、秋DFM软件可以 自动生成
    发表于 09-15 14:11

    【珍藏版】PCB阻抗设计与方案

    【珍藏版】PCB阻抗设计与方案,感兴趣的小伙伴们可以看看。
    发表于 07-26 11:11 0次下载

    秋干货 | PCB铜的DFM(可制造性)设计要点

    PCB设计铜是电路板设计的个非常重要的环节。 什么是PCB铜,就是将PCB上无布线区域闲置
    的头像 发表于 11-24 18:15 1049次阅读

    轻松搞定PCB阻抗设计

    决于选择的PCB结构。 由于最小线宽和最小线距是取决于PCB类型以及成本要求,受此限制,选择的PCB
    的头像 发表于 07-19 07:45 959次阅读

    秋干货轻松搞定PCB阻抗设计

    决于选择的PCB结构。 由于最小线宽和最小线距是取决于PCB类型以及成本要求,受此限制,选择的PCB
    的头像 发表于 07-27 18:15 648次阅读
    【<b class='flag-5'>华</b><b class='flag-5'>秋干货</b><b class='flag-5'>铺</b>】<b class='flag-5'>一</b><b class='flag-5'>文</b><b class='flag-5'>轻松</b><b class='flag-5'>搞定</b><b class='flag-5'>PCB</b><b class='flag-5'>叠</b><b class='flag-5'>层</b>和<b class='flag-5'>阻抗</b>设计

    秋干货轻松搞定PCB阻抗设计

    决于选择的PCB结构。 由于最小线宽和最小线距是取决于PCB类型以及成本要求,受此限制,选择的PCB
    的头像 发表于 07-31 10:15 772次阅读
    【<b class='flag-5'>华</b><b class='flag-5'>秋干货</b><b class='flag-5'>铺</b>】<b class='flag-5'>一</b><b class='flag-5'>文</b><b class='flag-5'>轻松</b><b class='flag-5'>搞定</b><b class='flag-5'>PCB</b><b class='flag-5'>叠</b><b class='flag-5'>层</b>和<b class='flag-5'>阻抗</b>设计

    RK3588 PCB推荐阻抗设计

    决于选择的PCB结构。由于最小线宽和最小线距是取决于PCB类型以及成本要求,受此限制,选择的PCB
    的头像 发表于 08-01 07:45 2402次阅读
    RK3588 <b class='flag-5'>PCB</b>推荐<b class='flag-5'>叠</b><b class='flag-5'>层</b>及<b class='flag-5'>阻抗</b>设计

    秋干货PCB阻抗设计12问,轻松带你搞懂阻抗

    阻抗,工程师们都接触过,但能把阻抗说清楚的工程师少之又少。阻抗看似简单,实则难以言表。 下面我们用快问快答的方式,轻松帮你搞懂阻抗! 0 1
    的头像 发表于 01-05 08:45 994次阅读
    【<b class='flag-5'>华</b><b class='flag-5'>秋干货</b><b class='flag-5'>铺</b>】<b class='flag-5'>PCB</b><b class='flag-5'>阻抗</b>设计12问,<b class='flag-5'>轻松</b>带你搞懂<b class='flag-5'>阻抗</b>