LogiCORE JTAG至AXI Master IP核简介
PG174中文文档简介
LogiCORE JTAG至AXI Master IP核是一个可定制的核，可生成AXIAXI总线可用于处理和驱动系统中FPGA内部的AXI信号。AXI总线接口协议可通过IP定制Vivado中的一个参数来选择。 集成设计环境(IDE)。AXI数据总线的宽度可定制。该IP可通过AXI4互连驱动AXI4-Lite或AXI4内存映射从站。运行时间与该内核的交互需要使用Vivado逻辑分析器功能。
特点
•提供AXI4主接口
•设置AXI4和AXI4-Lite接口的选项
•用户可选AXI数据宽度- 32和64
•用户可选AXI ID宽度，最多四位
•用户可选AXI地址宽度- 32和64
•与硬件交互的Vivado逻辑分析仪Tcl控制台界面
•支持AXI4和AXI4-Lite交易
PG174中文文档部分翻译预览
审核编辑：汤梓红
声明：本文内容及配图由入驻作者撰写或者入驻合作网站授权转载。文章观点仅代表作者本人，不代表电子发烧友网立场。文章及其配图仅供工程师学习之用，如有内容侵权或者其他违规问题，请联系本站处理。
举报投诉
-
接口
+关注
关注
33文章
8573浏览量
151007 -
JTAG
+关注
关注
6文章
398浏览量
71673 -
IP核
+关注
关注
4文章
327浏览量
49485 -
AXI
+关注
关注
1文章
127浏览量
16622
原文标题：中文文档|PG174 JTAG to AXI Masterv1.2
文章出处：【微信号：fpga加油站，微信公众号：fpga加油站】欢迎添加关注！文章转载请注明出处。
发布评论请先 登录
相关推荐
AXI VIP当作master时如何使用
AXI接口虽然经常使用，很多同学可能并不清楚Vivado里面也集成了AXI的Verification IP，可以当做AXI的master
使用JTAG到AXI Master无法调试设计的解决办法？
我根据以下快速拍摄视频完成了我的设计：http://www.xilinx.com/video/hardware/using-jtag-to-axi-master-in-vivado.html在视频
发表于 08-12 09:16
FPGA——API函数实现JTAG to AXI Master的读写操作
API函数实现JTAG to AXI Master的读写通过调用SDK里的API函数，可以实现通过JTAG线与FPGA内部逻辑通信。即在FPGA内部例化SDK里的
发表于 09-27 10:45
Xilinx的LogiCORE IP Video In to AXI4
Xilinx的视频的IP CORE 一般都是 以 AXI4-Stream 接口。 先介绍一下， 这个IP的作用。 下面看一下这个IP 的接口： 所以要把标准的VESA信号 转为
发表于 02-08 08:36
•604次阅读
AXI接口简介_AXI IP核的创建流程及读写逻辑分析
本文包含两部分内容：1）AXI接口简介；2）AXI IP核的创建流程及读写逻辑分析。 1AXI
Xilinx Logicore IP直接数字合成器DDS的用户手册免费下载
Xilinx Logicore IP直接数字合成器（DDS）编译核心采用Axi4流兼容接口，实现高性能、优化的相位生成和相位-正弦电路。
发表于 09-09 08:00
•20次下载
如何使用MicroBlaze调用AXI IP核详细解析
在一个项目中，当你使用microblaze作为控制器来进行系统调度的时候，一般是建议将所有模块封装成AXI形式的IP核，这样好管理，也容易调试。
AXI4-Stream Video 协议和AXI_VDMA的IP核介绍
本文主要介绍关于AXI4-Stream Video 协议和AXI_VDMA的IP核相关内容。为后文完成使用带有HDMI接口的显示器构建图像视频显示的测试工程做准备。
Video In to AXI4-Stream IP核知识介绍
大家好！今日分享一些关于Video In to AXI4-Stream IP 核的知识。在具体学习IP核的过程中，我也将分享一些关于如何看x
简单讲解AXI Interconnect IP核的使用方法
最近需要用到AXI接口的模块，xilinx的IP核很多都用到了AXI总线进行数据和指令传输。如果有多个设备需要使用AXI协议对
AXI VIP当作master时如何使用？
AXI接口虽然经常使用，很多同学可能并不清楚Vivado里面也集成了AXI的Verification IP，可以当做AXI的master、
LogiCORE IP AXI4-Stream FIFO内核解决方案
LogiCORE IP AXI4-Stream FIFO内核允许以内存映射方式访问一个AXI4-Stream接口。该内核可用于与AXI4-S
LogiCORE IP AXI UART 16550内核简介
LogiCORE IP AXI 通用异步接收发送器 (UART) 16550 连接到高级微控制器总线架构 (AMBA) AXI，为异步串行数据传输提供控制器接口。该软
工商网监
评论