CMOS的静电及过压

CMOS是指可编程逻辑门阵列（Programmable Logic Array），是一种由多个可编程逻辑门组成的集成电路，可以实现复杂的逻辑功能。

CMOS的静电及过压

CMOS的静电放电可能会导致电路损坏，而过压可能会导致电路过热，从而影响电路的性能和可靠性。因此，在使用CMOS时，应注意防止静电放电和过压。

对于模拟CMOS（互补对称金属氧化物半导体）而言，两大主要危害是静电和过压（信号电压超过电源电压）。了解这两大危害，用户便可以有效应对。

静电

由静电荷积累（V=q/C=1kV/nC/pF）而形成的静电电压带来的危害可能击穿栅极与衬底之间起绝缘作用的氧化物（或氮化物）薄层。这项危害在正常工作的电路中是很小的，因为栅极受片内齐纳二极管保护，它可使电荷损耗至安全水平。

然而，在插人插座时，CMOS器件与插座之间可能存在大量静电荷。如果插人插座的个引脚恰巧没有连接齐纳二极管保护电路，栅极上的电荷会穿过氧化层释放而损坏器件。

以下四步有助于防止器件在系统装配阶段受损：

将未使用的CMOS器件存放于黑色导电泡沫材料中，这样在运输时可以防止引脚之间积累电荷；

负责器件接插的操作人员应通过一个塑料接地带与系统电源地相连；

从防护性的泡沫材料中取出CMOS器件前，泡沫材料应与电源共地，释放掉积累的电荷；

在电路插人电路板之后，移动电路板时应保持电路板接地或屏蔽。

SCR闩锁

在使用模拟CMOS电路时，安全的做法是确保没有超过电源电压的模拟或数字电压施加到器件上，并且电源电压在额定范围内。尽管如此，实施承受过压保护也是有必要的。如果理解了问题的机制，保护措施在大多数情况下都会是行之有效的。

图1是一个典型CMOS输出开关单元的电路图及截面图。从不同单元和区域之间的连接关系中，我们可以画出一个等效二极管电路图（图2）。如果在S端或D端的模拟输人电压超过电源电压。

图1：典型CMOS输出开关单元的电路图及截面图

图2：等效二极管电路图

由不同二极管结产生的寄生晶体管就会处于正向偏置模式。这些寄生的NPN和PNP晶体管形成如图3所示的SCR（可控硅整流器）电路。

图3. CMOS开关中的寄生晶体管益沦应

过压能引起过大的电流和金属化问题。通常，运算放大器的输出作为S端或D端的电压源，因此电流不能大于运算放大器直流输出电流的限值。然而，瞬态感应电流仍有可能破坏CMOS器件；因此，有必要进行保护。

图4举例说明了通过在电源供电引脚串联二极管（比如1N459）防止寄生晶体管导通的方法。如果S端或D端电压高于电源电压时，CR1和/或CR2反向偏置，基极驱动电路不能使晶体管导通。每个CMOS器件都应该有一对独立的二极管对其进行保护。尽管这个方法很有效，但它不是万无一失的。如果开关的一端连接到一个负电位（例如一个充电电容），并且另一端电压超过VDD，则尽管有保护二极管。

图4：电路保护方案

在Q2的一个发射极的雪崩二极管足够提供基极驱动使Q2导通。对于这种情况，必须要有一个与电容串联的限流电源或者电阻。

如果在S端或D端有瞬时过压，那么由电压源供电的端口处的串联电阻的建议值为300至400Ω（图4b）。

CMOS的注意事项

使用CMOS时，应注意以下几点：

1、避免静电放电；2、避免过压；3、避免过流；4、避免过热；5、避免湿度过高；6、避免振动过大；7、避免磁场干扰；8、避免电磁干扰。