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?? ACT138解码器/解复用器专为需要非常短的传播延迟时间的高性能存储器解码和数据路由应用而设计。在高性能存储器系统中，这些解码器可用于最小化系统解码的影响。当采用利用快速使能电路的高速存储器时，这些解码器的延迟时间和存储器的使能时间通常小于存储器的典型存取时间。这意味着解码器引入的有效系统延迟可以忽略不计。
二进制选择输入和三个使能输入的条件选择八条输出线中的一条。两个低电平有效和一个高电平有效使能输入可在扩展时减少对外部门或逆变器的需求。无需外部逆变器即可实现24线解码器，32线解码器只需一个逆变器。使能输入可用作多路分解应用的数据输入（参见应用信息）。
| Function |
| Technology Family |
| VCC (Min) (V) |
| VCC (Max) (V) |
| Channels (#) |
| Voltage (Nom) (V) |
| F @ Nom Voltage (Max) (Mhz) |
| ICC @ Nom Voltage (Max) (mA) |
| tpd @ Nom Voltage (Max) (ns) |
| Configuration |
| Type |
| IOL (Max) (mA) |
| IOH (Max) (mA) |
| Rating |
| Operating Temperature Range (C) |
| Package Group |
| Package Size: mm2:W x L (PKG) |
| Bits (#) |
| Digital input leakage (Max) (uA) |
| ESD Charged Device Model (kV) |
| ESD HBM (kV) |
| CD74ACT138 | CD54ACT138 |
|---|---|
| Decoder Demultiplexer | Decoder/Demultiplexer |
| ACT | ACT |
| 4.5 | 4.5 |
| 5.5 | 5.5 |
| 1 | 1 |
| 5 | 5 |
| 90 | 90 |
| 0.08 | 0.08 |
| 11 | 11 |
| 3:8 | 3:8 |
| Standard | Standard |
| 24 | 24/-24 |
| -24 | |
| Catalog | Military |
| -55 to 125 | -55 to 125 |
| PDIP SOIC | CDIP |
| See datasheet (PDIP) 16SOIC: 59 mm2: 6 x 9.9(SOIC) | See datasheet (CDIP) |
| 8 | 8 |
| 5 | 5 |
| 0.75 | 0.75 |
| 2 | 2 |
| 无样片 |
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