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?? HC112器件包含两个独立的J-K负边沿触发触发器。无论其他输入的电平如何，预置（PRE）\或清除（CLR）\输入的低电平都会设置或复位输出。当（PRE）\和（CLR）\无效（高电平）时，满足设置时间要求的J和K输入的数据被传送到时钟（CLK）脉冲的下降沿的输出。时钟触发发生在电压电平，并且与CLK脉冲的下降时间没有直接关系。在保持时间间隔之后，可以改变J和K输入处的数据而不影响输出的电平。这些多功能触发器通过将J和K连接在一起来执行拨动触发器。
| Technology Family |
| VCC (Min) (V) |
| VCC (Max) (V) |
| Bits (#) |
| F @ Nom Voltage (Max) (Mhz) |
| ICC @ Nom Voltage (Max) (mA) |
| tpd @ Nom Voltage (Max) (ns) |
| Input Type |
| 3-State Output |
| IOL (Max) (mA) |
| Output Type |
| Rating |
| Operating Temperature Range (C) |
| Package Group |
| Package Size: mm2:W x L (PKG) |
| SN54HC112 | SN74HC112 |
|---|---|
| HC | HC |
| 2 | 2 |
| 6 | 6 |
| 2 | 2 |
| 70 | 70 |
| 0.04 | 0.04 |
| 41 | 41 |
| CMOS | LVTTL/CMOS |
| No | |
| -4 | 4 |
| CMOS | CMOS |
| Military | Catalog |
| -55 to 125 | -40 to 85 |
| CDIP CFP LCCC | PDIP SOIC |
| See datasheet (CDIP) See datasheet (CFP) 20LCCC: 79 mm2: 8.89 x 8.89(LCCC) | See datasheet (PDIP) 16SOIC: 59 mm2: 6 x 9.9(SOIC) |
| 无样片 |
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