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?? AC109器件包含两个独立的J-K \正边沿触发触发器。无论其他输入的电平如何,预置(PRE)\或清除(CLR)\输入的低电平都会设置或复位输出。当PRE \和CLR \无效(高电平)时,符合建立时间要求的J和K输入数据将传输到时钟(CLK)脉冲正向边沿的输出。时钟触发发生在电压电平,并且与时钟脉冲的上升时间没有直接关系。在保持时间间隔之后,可以更改J和K \输入处的数据,而不会影响输出的电平。这些多功能触发器可以通过接地K \和将J连接到高电平来执行拨动触发器。如果J和K \连在一起,它们也可以作为D型触发器执行。
Technology Family |
VCC (Min) (V) |
VCC (Max) (V) |
Bits (#) |
F @ Nom Voltage (Max) (Mhz) |
ICC @ Nom Voltage (Max) (mA) |
tpd @ Nom Voltage (Max) (ns) |
Input Type |
IOL (Max) (mA) |
Output Type |
Rating |
Operating Temperature Range (C) |
Package Group |
Package Size: mm2:W x L (PKG) |
CD54AC109 | CD74AC109 |
---|---|
AC | AC |
1.5 | 1.5 |
5.5 | 5.5 |
2 | 2 |
100 | 100 |
0.04 | 0.04 |
11.1 | 11.1 |
LVTTL/CMOS | LVTTL/CMOS |
-24 | 24 |
CMOS | CMOS |
Military | Catalog |
-55 to 125 | -55 to 125 |
CDIP | PDIP SOIC |
See datasheet (CDIP) | See datasheet (PDIP) 16SOIC: 59 mm2: 6 x 9.9(SOIC) |
无样片 |