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数据: DS92LV18 18-Bit Bus LVDS Serializer/Deserializer - 15-66 MHz 数据表
DS92LV18串行器/解串器(SERDES)对透明地将18位并行总线转换为带有嵌入式时钟信息的BLVDS串行流。通过消除并行数据和时钟路径之间的偏差问题,这种单串行流简化了在PCB走线和电缆上传输18位或更少的总线。它通过缩小数据路径来节省系统成本,从而减少PCB层,电缆宽度,连接器尺寸和引脚。
此SERDES对包括内置系统和器件测试功能。线路环回功能使用户能够检查发送器和接收器的串行数据传输路径的完整性,同时将串行数据反序列化为接收器输出端的并行数据。本地环回功能使用户能够从本地并行总线端检查收发器的完整性。
DS92LV18在高速I /O上集成了修改后的BLVDS信令。 BLVDS提供低功耗和低噪声环境,可通过串行传输路径可靠地传输数据。通过差分数据路径的相等和相反的电流通过将产生的边缘场耦合在一起来控制EMI。
所有商标均为其各自所有者的财产。
Protocols |
Function |
Parallel Bus Width (bits) |
Compression Ratio |
ESD (kV) |
Input Compatibility |
Output Compatibility |
Supply Voltage(s) (V) |
Data Throughput (Mbps) |
Rating |
Operating Temperature Range (C) |
Package Group |
Package Size: mm2:W x L (PKG) |
Pin/Package |
DS92LV18 |
---|
Channel-Link I |
SerDes |
18 |
18 to 1 |
2 |
LVTTL BLVDS |
LVDS BLVDS LVTTL |
3.3 |
2376 |
Catalog |
-40 to 85 |
LQFP |
80LQFP: 196 mm2: 14 x 14(LQFP) |
80LQFP |