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该器件具有两个可通过IN_SEL控制引脚进行选择的差分输入。两个输入都具有带中心抽头、差分的100 Ω片上端接电阻。支持直流耦合的LVPECL、CML和3.3 V CMOS(单端)和交流耦合的1.8 V CMOS、LVDS和LVPECL输入。VREFx引脚可用来为交流耦合输入提供偏置。
ADCLK954具有12个全摆幅的发射极耦合逻辑(ECL)输出驱动器。对于LVPECL(正ECL)输出,将Vcc偏置到地。对于ECL输出,将VCC偏置到地,将VEE偏置到负电源。
输出级设计成可以将每端800 mV直接驱动至端接于VCC − 2 V 的50 Ω电阻,从而获得1.6 V的总差分输出摆幅。
ADCLK954采用40引脚LFCSP封装,额定工作温度范围为−40℃至+85℃的标准工业温度范围。