带引脚控制的 8 通道输出 1.8V、2.5V 和 3.3V LVDS 缓冲器
| Function | Clock buffer, Differential |
| Additive RMS jitter (Typ) (fs) | 50 |
| Output frequency (Max) (MHz) | 2000 |
| Number of outputs | 8 |
| Output supply voltage (V) | 1.8, 2.5, 3.3 |
| Core supply voltage (V) | 1.8, 2.5, 3.3 |
| Output skew (ps) | 20 |
| Features | 2:8 fanout, Universal inputs, Individual output enable control, Pin control |
| Operating temperature range (C) | -40 to 105 |
| Rating | Catalog |
| Output type | LVDS |
| Input type | HCSL, LP-HCSL, LVCMOS, LVDS, LVPECL |
- 具有 2 路输入和 8 路输出 (2:8) 的高性能 LVDS 时钟缓冲器系列
- 输出频率最高可达 2GHz
- 通过硬件引脚实现启用/禁用独立输出
- 电源电压：1.8V/2.5V/3.3V ± 5%
- 低附加抖动：156.25MHz 下小于 12kHz 至 20MHz 范围内的 60fs rms 最大值
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超低相位本底噪声：-164dBc/Hz（典型值）
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超低传播延迟：< 575ps（最大值）
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输出延迟：20ps（最大值）
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失效防护输入
- 通用输入接受 LVDS、LVPECL、LVCMOS、HCSL 和 CML
- LVDS 基准电压 (VAC_REF) 适用于容性耦合输入
- 工业温度范围：–40°C 至 105°C
- 可用封装：
- 6mm × 6mm 40 引脚 VQFN (RHA)
LMK1D1208P 时钟缓冲器将两个中的任何一个可选时钟输入（IN0 和 IN1）分配给 8 对差分 LVDS 时钟输出（OUT0 至 OUT7），通过超小延迟实现时钟分配。输入可以为 LVDS、LVPECL、LVCMOS、HCSL 或 CML。
LMK1D1208P 专为驱动 50? 传输线路而设计。在单端模式下驱动输入时，对未使用的负输入引脚施加适当的偏置电压（请参阅Figure 8-6）。IN_SEL 引脚用于选择要发送到输出的输入。该器件支持失效防护输入功能。该器件还整合了输入迟滞，可防止在没有输入信号的情况下输出随机振荡。
各个 LVDS 差分输出均可通过将对应的 OEx 引脚设置为逻辑高电平“1”来实现。如果此引脚设置为逻辑低电平“0”，输出将被禁用，呈现高阻态，从而降低功耗。
该器件可在 1.8V、2.5V 或 3.3V 电源环境下工作，额定温度范围是 –40°C 至 105°C（环境温度）。
