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该文件描述了多通道缓冲串行端口（MCBSP）的263X/28 23 X设备。
这个设备提供多达两个高速多通道缓冲串行端口（McBSP），允许直接接口编解码器和系统中的其他设备。MCBSP由一个数据流路径和一个由六个引脚连接到外部设备的控制路径组成，如图1-1所示。
数据通过数据发送（DX）管脚用于发送，并通过数据接收（DR）管脚用于接收，被传送到与McBSP接口的设备。时钟和帧同步形式的控制信息通过以下管脚进行通信：CLKX（发送时钟）、CLKR（接收时钟）、FSX（发送帧同步）和FSR（接收帧同步）。
CPU和DMA控制器通过可经由内部外围总线访问的16位宽的寄存器与McBSP通信。CPU或DMA控制器将要发送的数据写入数据发送寄存器（DXR1，DXR2）。写入DXR的数据通过发送移位寄存器（XSR1，XSR2）被移位到DX。类似地，DR管脚上的接收数据被移位到接收移位寄存器中。rs（RSR1，RSR2）并复制到接收缓冲寄存器（RBR1，RBR2）中。然后将RBR的内容复制到DRR，DRR可以由CPU或DMA控制器读取。这允许同时进行内部和外部数据通信。
如果串行字长是8位、12位或16位，则不使用DRR2、RBR2、RSR2、DXR2和XSR2（写入、读取或移位）。对于较大的字长，这些寄存器需要保持最重要的位。
帧和时钟环回是在芯片级上实现的，以使CLKX和FSX能够驱动CKR和FSR。如果启用回环，则CLKR和FSR从CLKX和FSX焊盘获得它们的信号；而不是CLKR和FSR引脚。
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