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DMA总线
此总线将DMA的AHB主控接口与总线矩阵相联，总线矩阵协调着CPU的DCode和DMA到
SRAM、闪存和外设的访问。
总线矩阵
此总线矩阵协调内核系统总线和DMA主控总线之间的访问仲裁。此仲裁利用轮换算法。此总线
矩阵由四个驱动部件（CPU的DCode、系统总线、DMA1总线和DMA2总线）和四个被动部件（闪存
存储器接口（FLITF）、SRAM、FSMC和AHB2APB桥）构成。
AHB外设通过总线矩阵与系统总线相连，允许DMA访问。
AHB/APB桥（APB）
两个AHB/APB桥在AHB和2个APB总线间提供同步连接。APB1操作速度限于36MHz，APB2操
作于全速（最高72MHz）。
有关连接到每个桥的不同外设的地址映射请参考表1。在每一次复位以后，所有除SRAM和
FLITF以外的外设都被关闭，在使用一个外设之前，必须设置寄存器RCC_AHBENR来打开该外
设的时钟。
意： 当对APB寄存器进行8位或者16位访问时，该访问会被自动转换成32位的访问：桥会自动将8位
或者32位的数据扩展以配合32位的向量。
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