资料介绍
This quadruple bus buffer gate is designed for 1.65-V to 3.6-V VCC operation.
The SN74LVC125A features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE) input is high.
To ensure the high-impedance state during power up or power down, OE should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
Inputs can be driven from either 3.3-V or 5-V devices. This feature allows the use of this device as a translator in a mixed 3.3-V/5-V system environment.
- 具有三态输出的八边三栅D型触发器SN74LVC574A-EP数据表
- 具有三态输出的八边三栅D型触发器SN74LVC574A数据表
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- 具有三态输出的四总线缓冲门SN74LV125A-Q1数据表
- 具有三态输出的双总线缓冲门SN74LVC2G125-Q1数据表
- 具有三态输出的四总线缓冲门SN74AUC125 数据表
- 具有三态输出的八进制注册收发SN74LVC543A 数据表
- 具有三态输出的四总线缓冲门SN54BCT125A SN74BCT125A数据表
- 具有三态输出的四路总线缓冲门SN74LVC125A数据表
- 具有三态输出的四总线缓冲门SN54ABT125 SN74ABT125数据表
- 具有三态输出的四路总线缓冲门SN74LV125A数据表
- 具有三态输出的四总线缓冲门SN74LVC125A-EP数据表
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- 具有三态输出的SN74LVC1G125-Q1单总线缓冲门数据表
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