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The SN74ABT125Q-Q1 quadruple bus buffer gate features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE) input is high.
This device is fully specified for hot-insertion applications using Ioff and power-up 3-state. The Ioff circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down. The power-up 3-state circuitry places the outputs in the high-impedance state during power up and power down, which prevents driver conflict.
To ensure the high-impedance state during power up or power down, OE should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
- SN74AHCT32Q,pdf(Quadruple 2-In
- SN74AHCT32-Q1,pdf(Quadruple 2-
- SN74AHC32Q-Q1,pdf(Quadruple 2-
- SN74AHCT00Q-Q1,pdf(Quadruple 2
- SN74AHC00-Q1,pdf(Quadruple 2-I
- SN74LVC86A-Q1,pdf(Quadruple 2-
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- SN74LVT125-Q1,pdf(3.3-V ABT Qu
- SN74LVC125A-Q1,pdf(Quadruple B
- SN74LV125AT,pdf(QUADRUPLE BUS
- SN74AUC125,PDF(QUADRUPLE BUS B
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- SN74AHCT125-Q1,pdf(Quadruple B
- SN74AHC125Q,pdf(Quadruple Bus
- SN74AHC125-Q1,pdf(Quadruple Bu
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