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This bus-interface register is designed to eliminate the extra packages required to buffer existing registers and provide extra data width for wider address/data paths or buses carrying parity. The CY74FCT825T is an 8-bit buffered register with all the CY74FCT823T controls, plus multiple enables (OE\1, OE\2, OE\3) to allow multiuser control of the interface, e.g., CS\, DMA, and RD/WR\. This device is ideal for use as an output port requiring high IOL/IOH.
This device is designed for high-capacitance load drive capability, while providing low-capacitance bus loading at both inputs and outputs. Outputs are designed for low-capacitance bus loading in the high-impedance state.
This device is fully specified for partial-power-down applications using Ioff.
- CY74FCT2573T,pdf(8-Bit Latch)
- CY74FCT2573CT,pdf(8-Bit Latch)
- CY74FCT2573AT,pdf(8-Bit Latch)
- CY74FCT2373T,pdf(8-Bit Latch)
- CY74FCT2373CT,pdf(8-Bit Latch)
- CY74FCT2373AT,pdf(8-Bit Latch)
- CY74FCT823CT,pdf(9-Bit Bus-Int
- CY74FCT823BT,pdf(9-Bit Bus-Int
- CY74FCT823AT,pdf(9-Bit Bus-Int
- CY74FCT16823AT,pdf(16-Bit Regi
- CY74FCT16374CT,pdf(16-Bit Regi
- CY74FCT16374AT,pdf(16-Bit Regi
- CY74FCT162374CT,pdf(16-Bit Reg
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