资料介绍
The \x92FCT377T devices have eight triggered D-type flip-flops with individual data (D) inputs. The common buffered clock (CP) inputs load all flip-flops simultaneously when the clock-enable (CE\) input is low. The register is fully edge triggered. The state of each D input at one setup time before the low-to-high clock transition is transferred to the corresponding flip-flop output (O). CE\ must be stable only one setup time prior to the low-to-high clock transition for predictable operation.
These devices are fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.
- CY74FCT2573T,pdf(8-Bit Latch)
- CY74FCT2573CT,pdf(8-Bit Latch)
- CY74FCT2573AT,pdf(8-Bit Latch)
- CY74FCT2373T,pdf(8-Bit Latch)
- CY74FCT2373CT,pdf(8-Bit Latch)
- CY74FCT2373AT,pdf(8-Bit Latch)
- CY74FCT2574T,pdf(8-Bit Registe
- CY74FCT825CT,pdf(8-Bit Bus-Int
- CY74FCT2374T,pdf(8-Bit Registe
- CY74FCT16823AT,pdf(16-Bit Regi
- CY74FCT16374AT,pdf(16-Bit Regi
- CY74FCT162374AT,pdf(16-Bit Reg
- CY74FCT162646AT,pdf(16-Bit Lat
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