资料介绍
The ’AC109 devices contain two independent J-K\ positive-edge-triggered flip-flops. A low level at the preset (PRE)\ or clear (CLR)\ inputs sets or resets the outputs, regardless of the levels of the other inputs. When PRE\ and CLR\ are inactive (high), data at the J and K\ inputs meeting the setup-time requirements are transferred to the outputs on the positive-going edge of the clock (CLK) pulse. Clock triggering occurs at a voltage level and is not directly related to the rise time of the clock pulse. Following the hold-time interval, data at the J and K\ inputs can be changed without affecting the levels at the outputs. These versatile flip-flops can perform as toggle flip-flops by grounding K\ and tying J high.
- CD54AC74,CD74AC74 D型触发器数据表
- 双J-K正边三格触发器CD54ACT109 CD74ACT109 数据表
- 具有设置和重置正边缘触发器的双J-K触发器CD54HC109 CD74HC109 CD54HCT109 CD74HCT109数据表
- 双J-K正边三格清晰预置触发器CD54AC109 CD74AC109 数据表
- CD54AC299,CD74AC299,CD54AC323,
- CD54AC563,CD74AC563,CD54AC573,
- CD54AC373,CD74AC373,CD54AC533,
- CD54AC374,CD74AC374,CD54AC534,
- CD54AC651,CD74AC651,CD54AC652,
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- CD74AC244,CD74AC241,CD74AC240,
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