资料介绍
The SN74AHC595 contains an 8-bit serial-in, parallel-out shift register that feeds an 8-bit D-type storage register. The storage register has parallel 3-state outputs. Separate clocks are provided for both the shift and storage registers. The shift register has a direct overriding clear (SRCLR) input, serial (SER) input, and a serial output for cascading. When the output-enable (OE) input is high, all outputs, except QH', are in the high-impedance state.
Both the shift-register clock (SRCLK) and storage-register clock (RCLK) are positive-edge triggered. If both clocks are connected together, the shift register always is one clock pulse ahead of the storage register.
- SN74AVC8T245-Q1,pdf(8-Bit Dual
- SN74VMEH22501,pdf(8-BIT UNIVER
- SN74LV595A-Q1,pdf(8-Bit Shift
- SN54LV595A,SN74LV595A,pdf(8-Bi
- SN74HC595-EP,pdf(8-Bit Shift R
- SN54HC595,SN74HC595,pdf(8-Bit
- SN54HC594,SN74HC594,pdf(8-BIT
- SN74HC165-Q1,pdf(8-Bit Paralle
- SN54HC165,SN74HC165,pdf(8-BIT Parallel-load SHIFT REGISTERS)
- SN54F299,SN74F299,pdf(8-BIT UN
- SN54AHCT595, SN74AHCT595,pdf(8
- SN54AHC595, SN74AHC595,pdf(8-B
- SN54AHC594, SN74AHC594,pdf(8-B
- CD74HC595,PDF(8-BIT SHIFT REGI
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