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FPGA 原型设计人员艰苦努力所得的明显回报就是 ASIC* 设计可以及时而毫无问题地完成产品定案(tape-out)。不过，原型设计还有一点日益重要的优势，即 ASIC 或 SoC 中嵌入的软件在项目开发的早期阶段便可与实际速度硬件进行完美集成。
为什么软件团队要关注 FPGA 原型设计问题
独立的 EDA 分析师 Gary Smith 指出（见图 1），SoC 采用的CMOS工艺节点日益小型化，而且技术越来越复杂，因此软件组成部分已成为产品特色和开发焦点所在。进入市场的最新消费类器件多采用复杂的 SoC，其中包括众多嵌入式处理器和几十万甚至数百万行代码。Apple iPhone 就是一个很好的例子，它至少包含 3 个 ARM 处理器。加速产品上市进程对产品推出至关重要，在此情况下，怎么才能在 SoC 环境中进行软件验证呢？
SoC 开发团队越来越多地开始采用 FPGA 原型设计作为解决方案来进行验证并及时推出各种类型的产品。
为什么软件团队要关注 FPGA 原型设计问题
独立的 EDA 分析师 Gary Smith 指出（见图 1），SoC 采用的CMOS工艺节点日益小型化，而且技术越来越复杂，因此软件组成部分已成为产品特色和开发焦点所在。进入市场的最新消费类器件多采用复杂的 SoC，其中包括众多嵌入式处理器和几十万甚至数百万行代码。Apple iPhone 就是一个很好的例子，它至少包含 3 个 ARM 处理器。加速产品上市进程对产品推出至关重要，在此情况下，怎么才能在 SoC 环境中进行软件验证呢？
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