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电子发烧友网>电子资料下载>可编程逻辑>FPGA/ASIC>卷积码的Viterbi高速译码方案

卷积码的Viterbi高速译码方案

2010-07-21 | rar | 136 | 次下载 | 5积分

资料介绍

本文探讨了无线通信中广泛涉及的差错控制问题,介绍了卷积码的编译码原理。提出了一种卷积码编码,及其高速Viterbi译码的实现方案,对译码的各个组成部分作了分析,并在FPGA中实现了该译码方案。仿真结果表明,在纠正能力范围内,能够正确纠错并译码,且具有高速译码的优点,达到了预期的效果,该设计方案可以非常容易地应用到很多差错控制的通信系统中。
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