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综合是前端模块设计中的重要步骤之一，综合的过程是将行为描述的电路、RTL 级的 电路转换到门级的过程；Design Compiler 是 Synopsys 公司用于做电路综合的核心工具，它 可以方便地将 HDL 语言描述的电路转换到基于工艺库的门级网表。本章将初步介绍综合的 原理以及使用 Design Compiler 做电路综合的全过程。
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