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实验原理
CPLD芯片产生8位二进制循环加法计数值D7～D0，它们与AD558数据端相连，使DA转换产生0～2.56V的斜波电压，经一级运放放大一倍后成为0～5.12V（理论值，实际的动态范围是0～3.78V左右，在高就饱和位3.78V）。
可变电阻器模拟0～5V的模拟输入量，这个值被接入另一个运放的反向输入端，而DA转换放大的0～5.12V的电压量被接入运放的同相输入端，比较器运放的输出端接CPLD的输入管脚jmp。
工作时，可变电阻器输入一个Vtest值，而DA转换从0～5.12V循环扫描，当扫描值Vscan低于Vtest时，比较器输出的jmp为“0”，当扫描值Vscan高于Vtest时，比较器输出为“1”，而使jmp产生正向跳变的DA转换的数字量输入值DAOUT就代表模拟量Vtest的数值。
显示用习惯的十进制，并在芯片内部完成两倍显示转换。
以上各模块的大部分连线都已接好，只有个别端以适应实验的灵活性。
参考原理图如图12-1所示
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