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目标
创建一个新的Quartus®II项目
选择支持的设计输入方法
将设计编译成FPGA
查找生成的编译信息
创建设计约束（指定和设置）
管理I/O分配
进行时间分析并获得结果
Quartus II软件设计系列：验证
功率分析
调试解决方案
SignalProbe增量路由
系统内源和探测器
SignalTap II嵌入式逻辑分析仪
逻辑分析仪接口
系统内存内容编辑器
芯片规划和资源属性编辑器
QuartusⅡ软件设计系列：时序分析
使用TimeQuest计时分析器创建计时约束，以满足和优化计时要求
使用TimeQuest TA对Altera设备执行详细的定时分析
Quartus II软件设计系列：优化
增量编译
Quartus II优化特性和技术
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