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本文档介绍了时钟资源部分的功能、定义及使用方法。
该手册主要包括四个部分：
1. 时钟资源章节，主要介绍了时钟资源的整体布局、时钟资源种类及相关时钟资源原语介绍；
2. OSC 章节，介绍了内部晶振作为用户时钟的频率范围、参数设置及原语例化等；
3. DLL 章节，介绍了DLL 和DLLDLY 的功能、定义等；
4. PLL 章节，介绍了PLL 的功能、定义等。
本章介绍了高云半导体FPGA 产品的时钟资源，包括专用的时钟输入、缓冲区和布线资源。时钟的基础设施提供了一系列低电容、低偏移互连线，非常适合承载高频信号，最大限度地减少时钟偏差和提高性能，可应用于所有的时钟信号。
时钟资源及布线对FPGA 高性能的应用至关重要。高云半导体FPGA 产品提供了专用全局时钟网络（GCLK），直接连接到器件的所有资源。除了GCLK 资源，还提供了锁相环（PLL）、延迟锁相环（DLL）、高速时钟HCLK和DDR 存储器接口数据脉冲时钟DQS 等时钟资源。
GW1N/GW1NR 系列FPGA 产品
GCLK 在GW1N/GW1NR 系列产品中按象限分布，分成L、R 两个象限，如图3-1 所示：FPGA 被分成两个象限，每个象限提供8 个GCLK 网络，每个GCLK 可选时钟源包括专用的时钟输入管脚和普通的布线资源单元（CRU），使用专用的时钟输入管脚可以取得更好的时钟性能。
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