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电子发烧友网>电子资料下载>可编程逻辑>FPGA/ASIC>使用FPGA实现数字钟设计的资料说明

使用FPGA实现数字钟设计的资料说明

2021-01-19 | rar | 0.99 MB | 次下载 | 免费

资料介绍

  一、实验目的:

  通过设计实例,深入理解自顶向下设计方法,系统设计规范、系统设计、模块设计和系统仿真与实现各阶段的设计内容,初步掌握规范的数字系统设计方法并实践。

  二、实验要求:

  1、系统概述:设计一个用 LED 7段显示器显示的24小时制数字钟。

  2、系统目标:

  (1)用8个LED 显示时间,如9点25分10秒显示为,09-25-10。

  (2)设置2个按键,按键SET用于工作模式选择,按键UP用于设置数值。(可选)

  (3)按SET键循环设置工作模式为:正常显示-》时设置-》分设置-》秒设

  置。在设置工作模式时,被设置相应数字按1秒速率闪烁,其它数字不变。

  (4)在设置工作模式时,按UP键一次,被设置相应数字增加1,加到最大值后再加返回0,如小时加到23后再加就返回0,分和秒加到59后再加返回0 。

  3、系统设计依据:

  外部输入时钟为40MHZ,通过分频产生秒脉冲信号,用模60计数器对其计数产生分脉冲信号,对分脉冲用模60计数器对其计数产生时脉冲信号,再用模24计数器对时脉冲计数,即可实现一天24小时的时间信号,通过7段LED数码管显示出来则为基本数字钟,校时电路通过两个外部异步按键对“时”、“分”、“秒”显示数字进行校对调整。

  4、系统实现要求:

  要求用Mars-EP1C3-EDA实验平台。芯片与封装选择:本设计用EP1C3T FPGA实现,144脚封装,输入输出为LVTTL电平。

  5、系统验证及测试要求:

  用Mars-EP1C3-EDA实验平台搭建模拟测试平台测试,测试验证数字钟实现设计目标。

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