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选用M+12 Timing 0ncore Receiver GPS模块、CvcloneⅡ系列EP2C8现场可编程逻辑门阵列（FPGA）、10MHz高精度恒温晶振等设计硬件电路，实现GPs时钟在失步情况下精确对时。由GPS模块接收GPS卫星授时信号，输出秒脉冲和GPS时标至FPGA．同时恒温晶振10 MHz脉冲信号输至FPGA．经FPGA处理后的秒脉冲信号和GPS时标信息通过驱动电路并行送到串口或光纤模块。软件分成秒脉冲上升沿判别、10 MHz晶振脉冲计数、GPS失步情况下秒脉冲生成、GPS时标接收／发送4个功能模块．用VHDL语言对各软件模块进行功能开发．并给出了程序清单。仿真和试验结果表明，该方法可保证GPS时钟在失步12 h内秒脉冲误差小于50Us。
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