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VCS 是编译型Verilog 模拟器，它完全支持OVI 标准的Verilog HDL 语言、PLI 和SDF。
VCS 具有目前行业中最高的模拟性能，其出色的内存管理能力足以支持千万门级的ASIC 设计，而其模拟精度也完全满足深亚微米ASIC Sign-Off 的要求。VCS 结合了节拍式算法和事件驱动算法，具有高性能、大规模和高精度的特点，适用于从行为级、RTL 到Sign-Off 等各个阶段。VCS 已经将CoverMeter 中所有的覆盖率测试功能集成，并提供VeraLite、CycleC等智能验证方法。VCS 和Scirocco 也支持混合语言仿真。VCS 和Scirocco 都集成了Virsim图形用户界面，它提供了对模拟结果的交互和后处理分析。
VCS 具有目前行业中最高的模拟性能，其出色的内存管理能力足以支持千万门级的ASIC 设计，而其模拟精度也完全满足深亚微米ASIC Sign-Off 的要求。VCS 结合了节拍式算法和事件驱动算法，具有高性能、大规模和高精度的特点，适用于从行为级、RTL 到Sign-Off 等各个阶段。VCS 已经将CoverMeter 中所有的覆盖率测试功能集成，并提供VeraLite、CycleC等智能验证方法。VCS 和Scirocco 也支持混合语言仿真。VCS 和Scirocco 都集成了Virsim图形用户界面，它提供了对模拟结果的交互和后处理分析。
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