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[342] 什么是亚稳态？亚稳态是如何产生的？它有什么影响？

亚稳态是一种电路状态，在电路正常工作所需的时间内，电路无法稳定在的“ 0”或“ 1”逻辑电平的状态。通常在建立时间和保持时间违例时发生。

 

亚稳态可能会导致：

 

  1. 不可预测的系统行为。不同的扇出可能得到不同的信号值，从而导致设计进入未知状态。如果不稳定的数据（“ 0”或“ 1”）传播到设计中的不同部分，则可能导致高电流并最终芯片烧坏。

 

[343] 如何避免亚稳态？

通过在设计中使用同步器，可以避免跨时钟域时的亚稳态。同步器让信号有足够的时间从不稳定的振荡（“ 0”和“ 1”）稳定下来，从而获得稳定的输出。对于跨时钟域时可能出现的亚稳态，还可以使用包括握手机制、异步 FIFO 等方法。对于同步电路中，要进行合理的设计与设计约束，避免建立时间和保持时间违例。

 

[344] 同步器的构成是怎样的？

以下是一个同步器电路的例子。这是一个两个触发器同步器，第一个触发器等待一个时钟周期，使输入端的亚稳态稳定下来 / 逐渐消失，然后第二个触发器在输出端提供稳定的信号