资料介绍
如果您有接触使用 FPGA 的高速数据采集设计,没准听说过新术语“JESD204B”。
我在工作中看到过很多工程师询问有关 JESD204B 接口的信息以及它如何同 FPGA 协作。他们特别感兴趣的是 JESD204B 接口将如何简化设计流程。
与 LVDS 及 CMOS 接口相比,JESD204B 数据转换器串行接口标准可提供一些显著的优势,包括更简单的布局以及更少的引脚数。因此它能获得工程师的青睐和关注也就不足为奇了,它具备如下系统级优势:
更小的封装尺寸与更低的封装成本:JESD204B 不仅采用 8b10b 编码技术串行打包数据,而且还有助于支持高达 12.5Gbps 的数据速率。这可显著减少数据转换器和 FPGA 上所需的引脚数,从而可帮助缩小封装尺寸,降低封装成本;
简化的 PCB 布局与布线:更少的引脚数可显著简化 PCB 布局与布线,因为电路板上的路径更少…
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