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本应用笔记提供了防篡改(AT)指南和实际案例，以帮助保护UltraScale™和UltraScale+™ FPGA启用的系统中可能存在的IP和敏感数据。本应用笔记提供了防篡改 （AT） 指南和实际示例，以帮助保护由 UltraScale™ 和 UltraScale+ ™ FPGA 支持的系统中可能存在的知识产权 （IP） 和敏感数据。这种保护（以防篡改的形式）需要在 FPGA 由比特流配置之前、期间和之后有效。敏感数据可以包括设置 FPGA 功能的配置数据可能包含在比特流中的逻辑、关键数据和/或参数（例如，初始块 RAM 内容和触发器的初始状态）。它还包括外部数据在配置后正常操作期间动态进出FPGA。
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