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SN65LVDS93A LVDS SerDes（串行器/解串器）发送器在单个集成电路中包含 4 个 7 位并行负载串行输出 移位寄存器、1 个 7 时钟合成器以及 5 个低电压差动 信号 (LVDS) 驱动器。借助这些功能，可以通过 5 个 平衡对导体同步传输 28 位单端 LVTTL 数据并由兼容 的接收器（如 SN65LVDS94）进行接收。 发送数据时，数据位 D0 至 D27 会在输入时钟信号 (CLKIN) 边沿全部加载到寄存器中。可通过时钟选择 (CLKSEL) 引脚来选择时钟的上升沿或下降沿。CLKIN 的频率会实现比率为 7 的倍增，然后用于以串行方式 以 7 位时间片解除数据寄存器的负载。接着会将 4 个 串行数据流和锁相时钟 (CLKOUT) 输出至 LVDS 输出 驱动器。CLKOUT 的频率与输入时钟 (CLKIN) 相同。
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