资料介绍
随着半导体制造工艺的持续缩小,在90 纳米及以下的工艺中,时序、面积、
功耗以及可制造性的问题都日趋复杂。设计者希望在电子系统级 (ESL) 设计阶
段,就能知道他们的设计在目标工艺下能否达到预期要求。Mentor Graphics 公司
的Catapult Library Builder(以下简称Catapult LB),可以帮助半导体供应商提取高
层次综合(high level synthesis)所需要的工艺库。该工艺库能让客户把C/C++设计
直接映射到特定的半导体工艺库,进行性能和面积的预估分析,尽早对设计进行
优化和检验,增加设计成功的机会,同时该工艺库的建立也有利于半导体代工厂
商对新的先进工艺的推广。本文以中芯国际集成电路制造有限公司(SMIC) 90 纳
米的逻辑工艺库为例,介绍如何使用Catapult LB 为半导体供应商的特定工艺建
库,帮助客户实现从C/C++到GDSII 的先进设计流程。文章首先介绍Catapult LB
的建库流程,然后介绍Catapult LB 针对ASIC 工艺库不同的元件如标准单元、
存储单元等建库的具体方法,最后介绍如何验证元件库并加快建库过程。
功耗以及可制造性的问题都日趋复杂。设计者希望在电子系统级 (ESL) 设计阶
段,就能知道他们的设计在目标工艺下能否达到预期要求。Mentor Graphics 公司
的Catapult Library Builder(以下简称Catapult LB),可以帮助半导体供应商提取高
层次综合(high level synthesis)所需要的工艺库。该工艺库能让客户把C/C++设计
直接映射到特定的半导体工艺库,进行性能和面积的预估分析,尽早对设计进行
优化和检验,增加设计成功的机会,同时该工艺库的建立也有利于半导体代工厂
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的建库流程,然后介绍Catapult LB 针对ASIC 工艺库不同的元件如标准单元、
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