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乘法器

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乘法器（multiplier）是一种完成两个互不相关的模拟信号相乘作用的电子器件。它可以将两个二进制数相乘，它是由更基本的加法器组成的。乘法器可以通过使用一系列计算机算数技术来实现。

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乘法器技术

优秀的Verilog/FPGA开源项目-浮点运算器（FPU）介绍

浮点运算器（英文：floating point unit，简称FPU）是计算机系统的一部分，它是专门用来进行浮点数运算的（CPU中也叫ALU）。

2024-04-26 标签：处理器单片机乘法器 3105 0

Alpha半透明图形叠加算法Matlab+Verilog的设计实现

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2024-05-01 标签：matlab RGB 乘法器 615 0

一款以32位ARMCortexTM-M0处理器内核为基础的高性价比安全MCU

LKT6850是一款以32位ARMCortexTM -M0处理器内核为基础的高性价比安全MCU。LKT6850具有最高64KBFlash、4KBRAM、...

2024-04-19 标签：ARM处理器乘法器 UART接口 601 0

优化单片机程序代码的策略与方法

程序中使用的用户标识符除要遵循标识符的命名规则以外，一般不要用代数符号(如a、b、x1、y1)作为变量名，应选取具有相关含义的英文单词(或缩写)或汉语拼...

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基于FPGA的高效乘法器

乘数为1时需要左移的位数与数据位的权重其实有关，但是FPGA实现这样的运算并不算特别简单，还能不能简化？

2024-03-08 标签：FPGA 寄存器乘法器 808 0

verilog运算符的优先级

先给大家出一个题目：当x为5时，y=x << 6 + x <<3 + x << 2 + x的结果为多少，即y的值是多少？

2024-01-19 标签：Verilog 乘法器运算符 2857 0

如何利用xilinx器件中LUT的结构特征设计乘法器呢？

卷积占据了CNN网络中绝大部分运算，进行乘法运算通常都是使用FPGA中的DSP，这样算力就受到了器件中DSP资源的限制。

2024-01-19 标签：dsp 移位寄存器锁存器 1292 0

布斯算法（Booth Algorithm）乘法器的Verilog实现

Booth 的算法检查有符号二的补码表示中 'N'位乘数 Y 的相邻位对，包括低于最低有效位 y−1 = 0 的隐式位。

2023-12-04 标签：寄存器 Verilog 乘法器 2928 0

集成乘法器幅度调制与解调实验

掌握用MCl496集成模拟乘法器来实现AM和DSB调制的方法，并研究已调波与调制信号、载波之间关系

2023-11-08 标签：DDS 射极跟随器乘法器 8617 0

如何用LUT做一个可动态配置的卷积核呢？

由于卷积核数据在计算过程中保持不变，更新较慢。这样就可以利用LUT来存储权重并同时进行乘法运算。

2023-11-06 标签：dsp fpga 神经网络 794 0

混频器的本质原理

混频器也称为乘法器，它可以将两个不同频率的信号通过相乘的方式，得到他们之间频率和与差的新信号。

2023-10-31 标签：低通滤波器混频器乘法器 2425 0

FPGA数字信号处理-AM调制的实现

看到这个式子，首先肯定要产生两个频率不同的余弦波cos(w0t)，cos（wct）。立马想到调用系统自带的DDS IP核来实现，这是最简单的方法。

2023-10-17 标签：fpga 数字信号处理 DDS 1242 0

FPGA浮点IP内核究竟有哪些优势呢？

最近出现的 FPGA设计工具和 IP有效减少了计算占用的资源，大大简化了浮点数据通路的实现。而且，与数字信号处理器不同

2023-09-25 标签：dsp FPGA设计乘法器 694 0

INA226驱动程序

INA226是一款分流/功率监视器，具有IPCTM或SMBUS兼容接口。该器件监视分流压降和总线电源电压。可编程校准值、转换时间和取平均值功能与内部乘法...

2023-07-17 标签：接口监视器驱动程序 4161 0

时序约束怎么用？时序约束到底是要干嘛？

很多小伙伴开始学习时序约束的时候第一个疑惑就是标题，有的人可能会疑惑很久。不明白时序约束是什么作用，更不明白怎么用。

2023-06-28 标签：嵌入式系统乘法器触发器 1623 0

总结一下pipeline流水线设计的关键点

pipeline流水线设计是一种典型的面积换性能的设计。一方面通过对长功能路径的合理划分，在同一时间内同时并行多个该功能请求，大大提高了某个功能的吞吐率

2023-06-27 标签：处理器芯片设计乘法器 1991 0

FPGA时序分析之关键路径

关键路径通常是指同步逻辑电路中，组合逻辑时延最大的路径（这里我认为还需要加上布线的延迟），也就是说关键路径是对设计性能起决定性影响的时序路径。

2023-06-21 标签：逻辑电路寄存器乘法器 2178 0

乘法器的Verilog HDL实现方案

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2023-06-21 标签：FPGA设计 HDL 乘法器 1137 0

简易FM信号解调的FPGA实现过程讲解

FM解调需要去掉载波得到基带的信号，考虑到FM的特殊性，使用参考资料1中的小角度近似解调算法

2023-06-20 标签：滤波器 FPGA设计正弦波 4282 0

简易FM信号调制的FPGA实现过程讲解

AM是幅度调制，因此只需要将基带信号与载波信号相乘；FM是频率调制，以频率的变化来表示基带信号。

2023-06-20 标签：fpga DDS 乘法器 1995 0

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