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功耗技术

静态功耗的定义及FPGA设计中常用降低功耗的方法

静态功耗是指一个电路维持在一个或另一个逻辑状态时所需的功率。可以通过观察电路中每个电阻元件的电流I和压降V来计算每个元件的功率VI，并求和得到总功率，这...

2019-07-16 标签：fpga 寄存器功耗 1.1万 0

6大全新28nm 器件，功耗再降30%，扩大 28nm 领先地位

持续创新 28HPL 高性能低功耗工艺，成就跨越全新中低端器件，和 Artix-7 FPGA、Kintex-7 FPGA 及 Zynq-7000 SoC...

2019-08-01 标签：赛灵思功耗 28nm 3427 0

赛灵思宣布支持16nm UltraScale+器件工具与文档公开支持主流市场

通过与 Vivado 设计套件的协同优化可以完全发挥 UltraScale+ 产品系列的功耗性能比优势，以及 SmartCORE 及 LogiCORE ...

2019-08-01 标签：赛灵思功耗 16nm 2512 0

基于Virtex UltraScale FPGA的成本及功耗优化型铜线互连解决方案

连接您的服务器与架顶式交换机的方式中，与采用传统光学连接相比，铜线兼具成本及功耗优化的优势。您是否对采用更具成本效益的 25G 铜线连接更感兴趣。

2019-08-01 标签：fpga 功耗光学连接 2147 0

赛灵思推出丰富的智能解决方案能与安全、加密和 RegEx 功能方便集成

面向数据包处理的 Xilinx 智能方案包括 FPGA、 3D IC、和 SoC 以及一系列 SmartCORE IP，可进行定制优化以满足独特的市场需...

2019-07-31 标签：赛灵思功能功耗 2365 0

关于现代化汽车的安全和功耗要求的讲解

先进的汽车电子设备可提供更多功能，加强驾驶员安全保证，但代价却是导致电源波动的加剧。升降压技术可消除臃肿的电容器，降低系统成本并缩减尺寸。此外，集成PM...

2019-08-22 标签：电压功耗电池 3056 0

如何高效的设计嵌入式电路

开关量输出：基本原则是保证输出高电平接近电源电压，低电平接近地电平。I/O 口的吸纳电流一般大于放出电流。对小功率元器件控制最好是采用低电平控制的方式。...

2019-08-19 标签：电源芯片功耗 2874 0

深入分析开关损耗的改善办法

开关电源“待机功耗”问题就该这样解决

2019-06-14 标签：开关电源功耗 1.5万 1

DC-DC电源模块的待机功耗究竟耗哪了？

DC-DC电源模块待机的时候，输出端无负载，但产品又存在待机损耗，这些损耗都耗在了哪里，又该如何去减小这些损耗呢？本文将一探究竟。

2019-06-02 标签：功耗待机电源模块 1.6万 0

深入浅出玩转FPGA视频：MAX II的UFM模块使用实例

MAX II具有传统CPLD设计的低成本特性，MAX II CPLD还进一步提高了高密度产品的功耗和成本优势，可以使用MAX II CPLD来替代高功耗...

2019-12-18 标签：fpga cpld 功耗 3422 0

如何减少IC的功耗

功耗是一个“机会均等”问题：从早期设计取舍到自动物理功耗优化，所有降低功耗的技术都彼此相互补充，并且需要作为每个现代设计流程中的一部分加以考虑。工程师在...

2019-02-13 标签：ic 功耗 2822 0

让你的MCU轻松低功耗

低功耗是MCU的一项非常重要的指标，比如某些可穿戴的设备，其携带的电量有限，如果整个电路消耗的电量特别大的话，就会经常出现电量不足的情况，影响用户体验。...

2019-01-01 标签：mcu 时钟功耗 3467 0

如何操作Xilinx功耗估算器

了解如何使用可用工具在UltraScale器件上执行功耗分析，以及如何估算从7系列FPGA迁移的设计的功耗。还要了解如何操作Xilinx功耗估算器。

2018-11-23 标签：fpga 赛灵思功耗 4385 0

Kintex UltraScale FPGA KCU105评估套件的特点性能介绍

查看Kintex®UltraScale™FPGA KCU105评估套件，该评估套件具有完美的开发环境，可用于评估尖端的Kintex UltraScale...

2018-11-26 标签：fpga asic 功耗 4878 0

UltraScale+ SEU解决方案的集成测试

了解如何为UltraScale +设计添加额外的安全级别。该视频演示了如何防止差分功耗分析（DPA），以在比特流配置之上增加额外的安全性。

2018-11-26 标签：赛灵思功耗设计 1937 0

如何防止差分功耗分析的演示

了解如何为UltraScale +设计添加额外的安全级别。该视频演示了如何防止差分功耗分析（DPA），以在比特流配置之上增加额外的安全性。

2018-11-26 标签：赛灵思功耗设计 1998 0

利用DSP48E2 Slice中的宽MUX产品反馈

了解如何为UltraScale +设计添加额外的安全级别。该视频演示了如何防止差分功耗分析（DPA），以在比特流配置之上增加额外的安全性。

2018-11-27 标签：赛灵思功耗设计 2880 0

UltraScale+的安全锁定

了解如何为UltraScale +设计添加额外的安全级别。该视频演示了如何防止差分功耗分析（DPA），以在比特流配置之上增加额外的安全性。

2018-11-27 标签：赛灵思功耗设计 1993 0

UltraScale器件上的集成100G以太网MAC和CAUI-4 IP的演示

查看UltraScale器件上可用的集成100G以太网MAC和CAUI-4 IP的演示。通过软件实现，该IP可节省高达80K的LUT和90％的功耗，...

2018-11-28 标签：以太网赛灵思功耗 5068 0

UltraScale收发器功耗降低功能

2018-11-28 标签：收发器赛灵思功耗 2598 0

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