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时序

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这里所说的时序其实就是指时序图，又名序列图、循序图、顺序图，是一种UML交互图。它通过描述对象之间发送消息的时间顺序显示多个对象之间的动态协作。

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时序技术

详解配置控制器局域网络(CAN)位时序实现系统性能优化

隔离有利于提高鲁棒性，但同时也会增加发射和接收两个方向的传播延迟。必须使该延迟增加一倍，以支持两个节点参与仲裁。如果系统允许的传播延迟是固定的，在增加隔...

2024-11-15 标签：CAN 时序局域网络 858 0

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优化FPGA（现场可编程门阵列）设计的性能是一个复杂而多维的任务，涉及多个方面和步骤。以下是一些关键的优化策略：一、明确性能指标确定需求：首先，需...

2024-10-25 标签：FPGA 存储器时序 171 0

DDR4时序参数介绍

DDR4（Double Data Rate 4）时序参数是描述DDR4内存模块在执行读写操作时所需时间的一组关键参数，它们直接影响到内存的性能和稳定性。...

2024-09-04 标签：DDR4 时序内存模块 1601 0

数字芯片设计验证经验分享（第三部分）：将ASIC IP核移植到FPGA上——如何确保性能与时序以完成充满挑战的

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DRAM内存操作与时序解析

在数字时代，DRAM（动态随机存取存储器）扮演着至关重要的角色。它们存储着我们的数据，也承载着我们的记忆。然而，要正确地操作DRAM并确保其高效运行，了...

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为什么使用差分信号

差分信号是一种在电子和通信系统中广泛使用的信号传输方式，它通过比较两个电信号之间的差异（电压差）来传递信息。与单端信号不同，后者只参考一个单一的电位，差...

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FPGA设计的常用基本时序路径分析

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Vivado时序问题分析

有些时候在写完代码之后呢，Vivado时序报红，Timing一栏有很多时序问题。

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从WasmEdge运行环境读写Rust Wasm应用的时序数据

WebAssembly (Wasm) 正在成为一个广受欢迎的编译目标，帮助开发者构建可迁移平台的应用。最近 Greptime 和 WasmEdge 协作...

2023-12-22 标签：时序 MySQL 编译 951 0

LLC的工作原理 LLC基波简化分析法

如图1，LLC有两个谐振频率。一个由谐振分量 Lr 和 Cr 确定。另一个由 Lm、Cr 和负载条件确定。随着负载越来越重，谐振频率将向更高的频率移动。...

2023-12-12 标签：负载 LLC 时序 2.9万 0

嵌入式软件时序设计相关的问题

软件时序设计相关的问题时序问题是最容易出问题的地方，“时”代表时间顺序和时效性，一旦执行顺序错乱，或执行过慢失去时效，就会导致错误。消息的串行化处理 ...

2023-12-07 标签：数据处理嵌入式软件时序 512 0

如何计算传输线之间的延时差/偏移

编者注：在电路设计中时序是非常重要的，时序也是信号完整性研究的主要内容之一。较大的延时差/偏移（Skew）会直接导致电路时序不满足要求，从而导致产品设计...

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电源时序规格及控制框图

2023-12-15 标签：电源时序 679 0

电源时序规格②：电路和常数计算示例

2023-12-05 标签：电源电路时序 619 0

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针对DFX设计，Vivado提供了命令report_pr_configuration_analysis，该命令会从设计复杂度、时钟和时序等方面对其进行分...

2023-11-09 标签：fpga 命令时序 822 0

DFX设计如何分析

选项-complexity聚焦在设计的资源使用情况，会给出指定RP下各RM的资源使用情况，同时给出各RM之间相比各种资源使用量的最大值，这需要用到选项-...

2023-11-09 标签：时钟时序 Vivado 625 0

FIFO为什么不能正常工作？

FIFO为什么不能正常工作？复位信号有效长度不够，接口时序不匹配，可看下面这篇文章。本文将介绍：非DFX工程如何确保异步FIFO自带的set_max...

2023-11-02 标签：fpga FPGA设计 fifo 1253 0

CAN总线位时序的介绍

CAN控制器根据两根线上的电位差来判断总线电平。总线电平分为显性电平和隐性电平，二者必居其一。发送方通过使总线电平发生变化，将消息发送给接收方。显性电...

2023-10-27 标签：CAN 总线时序 1643 0

常用的时序反标方法和EDA工具反标方法

前段时间，一个朋友聊叙到这个后仿真任务命令都咋用，随即整理了下，可以完成基本的后仿真不成问题，但是如果还要完成一些其他的幺蛾子，那就需要各位仔细研读各工...

2023-10-25 标签：仿真 Verilog System 4417 0

如何让级联URAM获得最佳时序性能

在上一篇文章里《如何使用UltraScale+芯片中UltraRam资源》，我们向大家介绍了在RTL设计中使用URAM的方法。其中，我们推荐大家使用Xi...

2023-09-26 标签：芯片 Xilinx RTL 2226 0

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