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时序

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这里所说的时序其实就是指时序图，又名序列图、循序图、顺序图，是一种UML交互图。它通过描述对象之间发送消息的时间顺序显示多个对象之间的动态协作。

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时序技术

FPGA知识汇集-源同步时序系统

针对普通时钟系统存在着限制时钟频率的弊端，人们设计了一种新的时序系统，称之为源同步时序系统。它最大的优点就是大大提升了总线的速度，在理论上信号的传送可以...

2022-12-26 标签：fpga pcb 时序 1022 0

多电源IC的上电时序控制你搞明白了么

随着集成电路时代的到来，许多功能模块被集成到一个IC中，因而需要利用多个电源为这些模块供电。这些电源的电压有时候相同，但更多时候是不同的。市场上的片上系...

2022-12-19 标签：IC 时序上电 1594 0

FPGA知识汇集-FPGA时序基础理论

对于系统设计工程师来说，时序问题在设计中是至关重要的，尤其是随着时钟频率的提高，留给数据传输的有效读写窗口越来越小，要想在很短的时间限制里，让数据信号从...

2022-12-13 标签：处理器 fpga 时钟 2220 0

电源中电容选择并不是越大、越多越好

在不计成本的情况下，有些刚学电子的同学可能认为：电容选越大的越好，这样滤波效果好;并联多个更好，这样总的ESR值越小。

2022-11-25 标签：电源电容时序 1.2万 0

Zynq UltraScale+ZU+的电源域

PS部分和PL部分的上电时序是独立的，为了防止损坏器件，器件内部已经进行了隔离。

2022-11-02 标签：电源接口 Xilinx 1835 0

如何检查时序窗口的稳定性

描述设计时序时，所有的时序检查都有一个参考事件（reference event）和一个数据事件（data event），数据事件常常是数据信号，而参考事...

2022-10-19 标签：数据时序 3795 0

与初始化相关的重要寄存器介绍

在上例中，介绍了配置OV5640所需的SCCB时序，以及具体的实现。本例将介绍与初始化相关的重要寄存器，以及上电时序。

2022-10-18 标签：寄存器摄像头时序 1669 0

FlexSPI外设关于行列地址Memory支持

但是市面上也有一些特殊的存储器（比如八线 HyperBus Flash/RAM， OctalRAM 等）采用了行列混合寻址方式，对于这类存储器，我们在 ...

2022-10-14 标签：存储器 Memory 时序 1045 0

FlexSPI外设如何支持行列混合寻址存储器

关于FlexSPI外设的lookupTable，之前写过一篇非常详细的文章《从头开始认识i.MX RT启动头FDCB里的lookupTable》，这篇...

2022-10-13 标签：寄存器存储器时序 1119 0

Vivado IDE 中的Timing Constraints窗口介绍

随着设计复杂度和调用 IP 丰富度的增加，在调试时序约束的过程中，用户常常会对除了顶层约束外所涉及的繁杂的时序约束感到困惑而无从下手。举个例子，用户在 ...

2022-09-15 标签：接口时序 Vivado 1591 0

时序不满足的典型案例及解决方法

原先的时序报告：根据时序报告中的路径提示，在ILA的某个路径上建立时间过长，而程序中并未例化ila的核，只是使用了chipscrop.。所以猜测是ch...

2022-08-22 标签：时钟程序时序 1723 0

关于相对论里因果律的问题

在牛顿力学里，时间是绝对的，所有参考系都共用同一个时间。因此，只要在某个参考系里事件A先于事件B发生，那必然在所有的参考系里事件A都先于事件B。

2022-08-15 标签：时序牛顿 1301 0

FPGA时序分析时fast corner和slow corner是什么？

与双极晶体管不同，在不同的晶片之间以及在不同的批次之间，MOSFETs 参数变化很大。为了在一定程度上减轻电路设计任务的困难，工艺工程师们要保证器件的...

2022-08-10 标签：fpga 时序 SiCMOSFETs 2877 0

AXI总线协议的几种时序介绍

由于ZYNQ架构和常用接口IP核经常出现 AXI协议，赛灵思的协议手册讲解时序比较分散。所以笔者收藏AXI协议的几种时序，方便编程。

2022-08-02 标签：时序总线协议 AXI 7982 0

从已布线设计中提取模块用于评估时序收敛就绪状态

本文旨在提供一种方法，以帮助设计师判断给定模块是否能够在空裸片上达成时序收敛。如果目标模块无法在空裸片上达成非关联 (OOC) 时序收敛，则恐难以与...

2022-08-02 标签：Xilinx 布线时序 538 0

不同操作系统间QoR性能存在差异

本篇博文中的分析是根据真实客户问题撰写的，该客户发现不同操作系统间 QoR 性能存在差异。虽然可以理解赛灵思无法保证不同操作系统间的可重复性，正如&qu...

2022-08-02 标签：Linux WINDOWS 时序 1085 0

硬件中存在DDR4校准错误的调试方法与根本原因分析

本篇博文中的分析是根据真实客户问题撰写的，该客户发现硬件中存在 DDR4 校准错误，不同板以及不同构建 (build) 之间出现的故障并不一致。本篇博文...

2022-08-02 标签：DDR4 时序校准 5554 0

时钟域交汇相关处理错误的根本原因分析

本篇博文中的分析是根据真实客户问题撰写的，该客户发现在现场出现罕见的比特翻转, 本篇博文旨在演示用于缩小根本原因范围以及修复此问题的部分调试技巧。

2022-08-02 标签：时序时钟域 Vivado 980 0

DDR4 IP校准后硬件故障的调试方法与根本原因分析

本篇博客将为您演示如何使用此报告来帮助加速调试，甚至完全避免硬件故障，最后确定此问题根本原因是校准完成时出现争用状况。出现争用状况的原因是由于某个多周期...

2022-08-02 标签：DDR4 时序 2539 0

可靠的上电和关断时序

当今的电子应用常常需要不止一个5 V或3.3 V电源电压。10个、20个或更多的电压并不罕见。此外，有的电压域具有相同的电压电平，但必须作为单独的域产生...

2022-08-03 标签：电源 adi 时序 481 0

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