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时序

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这里所说的时序其实就是指时序图，又名序列图、循序图、顺序图，是一种UML交互图。它通过描述对象之间发送消息的时间顺序显示多个对象之间的动态协作。

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时序技术

FlexSPI外设如何支持行列混合寻址存储器

关于FlexSPI外设的lookupTable，之前写过一篇非常详细的文章《从头开始认识i.MX RT启动头FDCB里的lookupTable》，这篇...

2022-10-13 标签：寄存器存储器时序 1119 0

Vivado Schematic中的实线和虚线有什么区别？

2023-06-06 标签：fpga 时序 Schematic 1102 0

如何在EDA工具中屏蔽冗余的违例信息

在进行数字电路后仿真时，经常会遇到很多时序为例，通常这些违例都是由网表中大量的时序检查报出的。这些常见的时序检查系统任务如下表所示：

2023-08-19 标签：仿真 eda 数字电路 1096 0

不同操作系统间QoR性能存在差异

本篇博文中的分析是根据真实客户问题撰写的，该客户发现不同操作系统间 QoR 性能存在差异。虽然可以理解赛灵思无法保证不同操作系统间的可重复性，正如&qu...

2022-08-02 标签：Linux WINDOWS 时序 1085 0

XDC约束技巧之I/O篇（下）

继《XDC 约束技巧之 I/O 篇（上）》详细描述了如何设置 Input 接口约束后，我们接着来聊聊怎样设置 Output 接口约束，并分析 UCF ...

2023-04-10 标签：接口信号时序 1078 0

FPGA设计中经常犯的10个错误

本文列出了FPGA设计中常见的十个错误。我们收集了 FPGA 工程师在其设计中犯的 10 个最常见错误，并提供了解决方案的建议和替代方案。本文假定读者已...

2023-05-31 标签：fpga FPGA设计 RTL 1077 1

用TCL定制Vivado设计实现流程

今天推出Xilinx已发布的《Vivado使用误区与进阶》系列：用TCL定制Vivado设计实现流程。

2023-05-05 标签：fpga Xilinx TCL 1048 0

FlexSPI外设关于行列地址Memory支持

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2022-10-14 标签：存储器 Memory 时序 1045 0

FPGA知识汇集-源同步时序系统

针对普通时钟系统存在着限制时钟频率的弊端，人们设计了一种新的时序系统，称之为源同步时序系统。它最大的优点就是大大提升了总线的速度，在理论上信号的传送可以...

2022-12-26 标签：fpga pcb 时序 1022 0

时钟域交汇相关处理错误的根本原因分析

本篇博文中的分析是根据真实客户问题撰写的，该客户发现在现场出现罕见的比特翻转, 本篇博文旨在演示用于缩小根本原因范围以及修复此问题的部分调试技巧。

2022-08-02 标签：时序时钟域 Vivado 980 0

详解时序路径的相关概念

reg2reg路径约束的对象是源寄存器（时序路径的起点）和目的寄存器（时序路径的终点）都在FPGA内部的路径。

2023-06-26 标签：fpga 寄存器时序 968 0

时序约束--多时钟

对于逻辑N而言，由clka产生数据，clkc采样数据，在它们周期的最小公倍数内，最严格的时序是3ns产生数据，在4ns采样。只要保证最严格的情形下，电路...

2023-04-06 标签：分频器时序 964 0

静态时序分析基础与应用连载（2）

除了Clock之外，对于电路其他输出输入端点及其周边的环境（Boundary Condition）也要加以描述。

2017-02-11 标签：时序静态时序 958 0

从WasmEdge运行环境读写Rust Wasm应用的时序数据

WebAssembly (Wasm) 正在成为一个广受欢迎的编译目标，帮助开发者构建可迁移平台的应用。最近 Greptime 和 WasmEdge 协作...

2023-12-22 标签：时序 MySQL 编译 951 0

有关FPGA的问答集锦

FPGA做IC的原型验证，速度大概跑多少？很多ASIC运行主频远远高于FPGA，仿真能cover住吗？

2023-06-19 标签：fpga 原型验证 lvds 945 0

FPGA设计中coding之前的五条铁律

文件注释：文件注释就是一个说明文：这通常在文件的头部注释，用于描述代码为那个工程中，由谁写的，日期是多少，功能描述，有哪些子功能，及版本修改的标示。这样...

2019-01-26 标签：fpga 时序 936 0

静态时序分析基础与应用连载（3）

假设前级Flip-Flop的讯号由1变0，计算第2条Path终点的AT。

2017-02-11 标签：时序静态时序 921 0

使用Virtual Eval工具了解AD7124-4/8的时序性能

在这个演示视频中，我们将使用Virtual Eval工具来了解AD7124-4/8的时序性能，并演示Virtual Eval工具的作用。

2023-09-07 标签：adc Virtual 时序 872 0

详解配置控制器局域网络(CAN)位时序实现系统性能优化

隔离有利于提高鲁棒性，但同时也会增加发射和接收两个方向的传播延迟。必须使该延迟增加一倍，以支持两个节点参与仲裁。如果系统允许的传播延迟是固定的，在增加隔...

2024-11-15 标签：CAN 时序局域网络 861 0

DFX设计如何分析

针对DFX设计，Vivado提供了命令report_pr_configuration_analysis，该命令会从设计复杂度、时钟和时序等方面对其进行分...

2023-11-09 标签：fpga 命令时序 822 0

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