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时序

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这里所说的时序其实就是指时序图，又名序列图、循序图、顺序图，是一种UML交互图。它通过描述对象之间发送消息的时间顺序显示多个对象之间的动态协作。

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如何修复硬件中存在DDR4校准错误

本篇博文中的分析是根据真实客户问题撰写的，该客户发现硬件中存在 DDR4 校准错误，不同板以及不同构建（build）之间出现的故障并不一致。本篇博...

2021-09-03 标签：DDR 硬件时序 2938 0

一文读懂时序分析与约束

时序冲突的概率变大以及电路的稳定性降低，为此必须进行时序、面积和负载等多方面的约束。

2021-06-15 标签：时序 3162 0

组合电路中0型冒险和1型冒险及其消除方法

什么是竞争和冒险？（1）竞争在一个组合电路当中，当某一个变量经过两条以上的路径到达输出端的时候，由于每条路径上的延迟时间的不同，到达终点的时间就会有...

2021-06-13 标签：电路时序 1.9万 0

关于打拍优化时序你真的全面了解吗？

如果你参加过IC校招面试，自然会被问到“setup/hold的概念，以及setup/hold违例怎么办？”

2021-04-27 标签：IC 时序 Setup 4513 0

生成时钟信号和执行各种基于时间的任务

许多模拟电路需要一种时钟信号，或者要求能在一定时间后执行某项任务。对于这样的应用，有各种各样适用的解决方案。 1、555定时器对于简单的时序任务，...

2022-02-22 标签：时序 1276 0

时序数据库的前世今生

时序数据库忽然火了起来。Facebook开源了beringei时序数据库，基于PostgreSQL打造的时序数据库TimeScaleDB也开源了。时...

2020-12-17 标签：数据库时序 3571 0

一文知道时序路径的构成

更为具体的时序报告信息如何从中获取，或者如何根据时序报告发现导致时序违例的潜在原因呢？

2020-09-04 标签：时序 1771 0

KUKA机器人对于涂胶设备的清胶控制

F346激活原位清胶,!A15机器人在原位和F356固定涂胶,或者F356固定涂胶和E2115摆臂在接胶位,或者不是外部自动,KL1_SPUELEN_A...

2020-06-11 标签：时序 KUKA机器人 2904 0

FPGA时序约束分析余量

FPGA在与外部器件打交道时，端口如果为输入则与input delay约束相关，如果最为输出则output delay,这两种约束的值究竟是什么涵义，在...

2019-11-10 标签：fpga ddr 时序 4342 0

浅析静态功耗和静态时序分析

STA贯穿设计过程的各个阶段，从RTL逻辑综合到布局、时钟树综合、布线和反标，直到tape_out。每一次分析的目的都是为了检查当前设计的结果是否满足设...

2019-11-02 标签：功耗时序 3818 0

浅析单片机通信时序

所谓“时序”从字面意义上来理解，一是“时间问题”，二是“顺序问题”。

2019-08-03 标签：单片机时序 3663 0

利用静态时序分析工具解决带宽不足问题

为提高带宽，很多类型的 Memory 都采用了 Double Data Rate（DDR）interface，它对在内存控制器（memory contr...

2019-08-03 标签：仿真时序 3678 0

总线的操作时序和操作方式详解

操作时序（timing）：各信号有效的先后顺序及配合关系

2019-06-24 标签：FPGA 时序 1.1万 0

设计PCB时需先进行沟通解决问题

PCB 设计是一项严肃的工作，要完成它并非易事。当出现串扰、高电流密度、跨越缝隙的走线、发热、时序要求等等问题时，解决方案只有一个。与产品创建专业人士交...

2019-05-13 标签：pcb 电流时序 3012 0

使用PADS Constraint Manager确保设计的性能要求

使用 PADS Constraint Manager，确保您的设计符合并持续符合时序和性能要求。

2019-05-17 标签：设计 pads 时序 3108 0

时序分析基础

时钟的时序特性主要分为抖动（Jitter）、偏移（Skew）、占空比失真（Duty Cycle DistorTIon）3点。对于低速设计，基本不用考虑这...

2019-03-08 标签：时序时序分析 3878 0

内存速度和时序重要么

最近是跟内存耗上了，其一是手里没有其它硬件可测，更重要的是想趁着这段时间，把内存与性能之间的影响都慢慢测一下。今天测的就是时序与内存性能之间的关系了。时...

2019-01-14 标签：内存时序 2.5万 0

关于优化FPGA HLS设计的分析和介绍

用软件从 C 转化来的 RTL 代码其实并不好理解。今天我们就来谈谈，如何在不改变 RTL 代码的情况下，提升设计性能。本项目所需应用与工具：赛灵思H...

2019-09-15 标签：fpga 时序代码 480 0

解决5G设备时序痛点 Emerald提升性能20倍

OCXO在时序中提供了顶级性能，是所有通信网络可靠运行的关键。和5G之前OCXO基本被部署在良好受控的环境中不同，5G时代的计算、核心网络和无线电都将被...

2018-11-05 标签：MEMS SiTime OCXO 2187 0

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FPGA设计和验证工程师当今面临的最大挑战之一是时间和资源制约。随着FPGA在速度、密度和复杂性方面的增加，完成一个完整时序验证对人力和计算机处理器、存...

2019-10-06 标签：FPGA设计存储器时序 1205 0

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