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赛灵思、Arm、Cadence和台积公司今日宣布计划在 2018 年交付 7 纳米 FinFET 工艺芯片。这一测试芯片旨在从硅芯片层面证明 CCIX ...
2017-09-25 标签:赛灵思 6958 0
现代 RF 信号链对于跨多通道的数据转换器性能具有极高的要求。换言之,对于赛灵思 RF Data Converter 而言,关键要求之一是在多个 ADC...
Xilinx可编程逻辑器件设计与开发(基础篇)连载15:Spartan
所有的Spartan-6 FPGA有高性能的可配置SelectIO驱动器与接收器,支持非常广泛的接口标准。可以通过编程控制I/O的输出强度、斜率以及片上...
低压差分传送技术是基于低压差分信号(Low Volt-agc Differential signaling)的传送技术,从一个电路板系统内的高速信号传送...
.PPR文件是PLANAHEAD的工程文件,在WINDOWS下面可以直接双击打开,PROJECT.cache PROJECT.data是项目产生的临时文...
如何在在Vivado中使用Cadence IES模拟进行仿真
了解如何使用Vivado中的Cadence IES Simulator在MicroBlaze IPI设计中运行仿真。 我们将演示如何编译仿真库,为IP...
部分重配置技术实现了动态可配置性,在切换设计中的某些部分时,其余部分还能继续保持工作,完全不需停机,且几乎不影响成本与开发时间。
如何在Vivado Design Suite 中进行IP加密
此视频概述了Vivado Design Suite中的IP加密。 它涵盖了IP加密工具流程,如何准备加密IP以及如何在Vivado中运行加密工具。
在QEMU软件仿真器上运行Zynq UltraScale+ MPSoC
Xilinx展示了在QEMU软件仿真器上运行的Zynq UltraScale + MPSoC。 四核ARM Cortex-A53在SMP模式下运行4个...
Zynq UltraScale+ RFSoC的功能特点与应用
在本演示视频中,Xilinx讨论了其Zynq®UltraScale+™RFSoC系列的产品详细信息。
HDMI VCU118设计移植到VCU128开发板的步骤解析
简介与视频示例设计概览 许多视频 IP 核都附带有示例设计。这些设计用于 IP 演示,并提供示例以供您在自己的设计中使用 IP 核时作为参考。 这些 I...
了解Xilinx SDK如何为您提供在Zynq全可编程器件上创建,开发,调试和部署嵌入式软件应用所需的所有工具。 该视频为您提供了Xilinx SDK...
在Xilinx Zynq UltraScale+ MPSoC中实现的NVMe主机加速器
在本演示中,Intelliprop演示了在Xilinx Zynq UltraScale + MPSoC中实现的NVMe主机加速器。
Ultra96 是一款基于 Arm 技术的赛灵思 Zynq UltraScale+ MPSoC 开发板,符合 Linaro 96Boards 规范。96...
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