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ASIC是Application Specific Integrated Circuit的英文缩写,在集成电路界被认为是一种为专门目的而设计的集成电路。ASIC也是Australian Securities and Investment Commission的英文缩写,即澳大利亚证券和投资委员会,它是澳大利亚金融服务和市场的法定监管机构。
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伴随着人工智能如火如荼的发展势态,底层芯片的发展也显得至关重要。硬件设计能力是企业科研实力的突出体现,安博会上所展示出的底层硬件将十分值得关注。
MathWorks在FPGA和ASIC上成功实现自动化视觉系统设计
MathWorks宣布,随着 2019b 发行版的 MATLAB 和 Simulink 产品系列最近上市,Vision HDL Toolbox提供对在 ...
Zipcores的IP核以通用、人类可读的VHDL或Verilog源代码编写,并与Xilinx、Intel、Lattice、Microsemi等各种主流...
Google AI完胜集成电路设计,ASIC智能设计时代来临
今年的集成固态电路会议(ISSCC)的主题是“为AI时代提供动力的集成电路”,而开幕全体会议的目的是描绘AI“折叠”半导体空间的程度。
Marvell推出业界首款双端口400GbE PHY,可确保加强点对点安全性
支持100G串行I/O接口和MACsec安全性能,可实现在数据中心和云端的高密度部署,凭借高速SerDes技术进一步稳固Marvell在PHY连接解决方...
有别于业界一般只提供芯片层级ESD服务,智原新增的系统级静电防护服务方案可进一步协助客户排除系统级静电问题,达到顺利量产的目的。
MathWorks宣布,HDLVerifier从现已上市的Release2019b开始提供对UniversalVerificationMethodolo...
芯片内部的EEPROM可以存储校正数据,对零漂和温漂进行了纠正,从而使该传感器在这两个方面的指标比传统的开环传感器均提到了一倍,这样就进一步保证了电流的...
安全审计公司Least Authority的审计师没有发现这点;Bob Rao、提议ProgPoW的IfDefElse,甚至研究人员Solardiz也没...
智原推出Low-DPPM通用方案 满足各领域ASIC的高可靠度需求
智原除了已有符合汽车电子协会AEC车规的Zero-DPPM解决方案,也藉此经验提供客户适用于非车用领域的Low-DPPM通用解决方案。
MathWorks通过Universal Verification Methodology (UVM)支持加快 FPGA和ASIC验证速度
Wilson Research Group 的一项最近研究发现,48% 的 FPGA 设计项目和 71% 的 ASIC设计项目依赖 UVM 进行设计验证。
MathWorks实现自动化视觉系统设计 提高了FPGA和ASIC的分辨率
2020 年 2 月 27 日– MathWorks 宣布,随着 2019b 发行版的 MATLAB 和 Simulink 产品系列最近上市,Visio...
在新年的第一个月中,研究公司Tokeninsight发布了其“采矿业年度研究报告”,其中涵盖了竞争激烈的比特币采矿业。
据Semico统计,FPGA市场正在逐年增长,而复合年均增长率高达38.4%,至2023年将具有55亿-60亿美元的规模。
台积电表示即将量产的5nm工艺实现了重大改进,与7nm工艺相比,在功耗、性能和面积等方面都得到了巨大的改善,通过使用EUV,使逻辑密度提高了了1.84倍...
据中时电子报报道,比特大陆(Bitmain)和嘉楠耘智(Canaan)这两家专门开发应用于挖掘加密货币的特殊应用集成电路(ASIC)的厂商,将成为台积电...
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