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BRAM和URAM重要的片上存储资源，两者有显著的区别

BRAM和URAM都可级联，只是级联方式不同。在使用BRAM时，我们只需要设定宽度和深度，并根据时钟频率合理选择Latency，也就是选择是否需要使用B...

2019-03-06 标签：寄存器 BRAM 2.8万 0

简单讲解AXI Interconnect IP核的使用方法

最近需要用到AXI接口的模块，xilinx的IP核很多都用到了AXI总线进行数据和指令传输。如果有多个设备需要使用AXI协议对AXI接口的BRAM进行读...

2023-06-19 标签：控制器 RTL VCS 9677 0

【FPGA ZYNQ Ultrascale+ MPSOC教程】33.BRAM实现PS与PL交互

有时CPU需要与PL进行小批量的数据交换，可以通过BRAM模块，也就是Block RAM实现此要求。本章通过Zynq的GP Master接口读写PL端的...

2021-02-22 标签：fpga cpu Zynq 8110 0

Vivado中BRAM IP的配置方式和使用技巧

FPGA开发中使用频率非常高的两个IP就是FIFO和BRAM，上一篇文章中已经详细介绍了Vivado FIFO IP，今天我们来聊一聊BRAM IP。

2023-08-29 标签：fpga 寄存器 fifo 5612 0

FPGA设计中BRAM的知识科普

FPGA设计中，BRAM是一项非常关键的内置存储资源，FPGA开发需要熟练使用BRAM，今天再复习一下BRAM的知识，包括BRAM的定义、组成、应用等等。

2023-08-15 标签：fpga DRAM FPGA设计 5002 0

Xilinx FPGA AXI4总线（二）用实例介绍5个读写通道

AXI4协议是一个点对点的主从接口协议，数据可以同时在主机（Master）和从机（Slave）之间**双向** **传输** ，且数据传输大小可以不同。

2023-06-21 标签：FPGA设计 FIFO存储 BRAM 3355 0

论SRAM型FPGA软核Microblaze抗单粒子加固的方法

Microblaze是32位/64位 RISC软核处理器，可以用作微处理器、实时处理器和应用处理器（Linux+MMU）。

2023-08-28 标签：fpga sram 微处理器 3354 0

MicroBlaze大内部存储器(AXI BRAM)设计

MicroBlaze可以使用AXI BRAM存放数据和指令。有些客户软件很大，需要把AXI BRAM的空间做到最大。AXI BRAM底层是Block R...

2022-08-02 标签：存储器 MicroBlaze BRAM 3111 0

奇数分频如何得到呢？解读奇数分频和逻辑分析仪（ILA）的使用

前言：偶数分频容易得到：N倍偶数分频，可以通过由待分频的时钟触发计数器计数，当计数器从0计数到N/2-1时，输出时钟进行翻转，并给计数器一个复位信号，...

2020-12-28 标签：计数器逻辑分析仪 BRAM 2922 0

如何复用原有设计中Block的位置

保存Block的位置信息。一旦固定了BRAM的位置，即可点击Vivado菜单栏内的保存按钮，这样就把BRAM的位置信息保存到了target约束文件中。一...

2019-01-29 标签：Block BRAM 2879 0

FPGA的BRAM资源使用优化策略

FPGA的BRAM和LUT等资源都是有限的，在FPGA开发过程中，可能经常遇到BRAM或者LUT资源不够用的情况。

2023-08-30 标签：fpga 芯片 ROM 2671 0

基于FPGA的图形生成与视频处理系统的设计与实现

本文对基于FPGA的机载视频图形显示系统架构进行设计和优化。从实时性、BRAM资源占用和DDR3吞吐量三方面进行分析，改进帧速率提升算法来提高实时性；改...

2017-11-18 标签：fpga ddr3 bram 2377 0

Xilinx FPGA AXI4总线（一）介绍【AXI4】【AXI4-Lite】【AXI-Stream】

从 FPGA 应用角度看看 AMBA 总线中的 AXI4 总线。

2023-06-21 标签：控制器 FPGA设计 DDR 2228 0

怎样使用毛刺滤波器来滤除毛刺和反弹？

可编程逻辑系统通常部署在可能存在噪声的应用中。这种噪声会影响可编程逻辑设计接收的信号。

2023-08-30 标签：滤波器寄存器状态机 2197 0

fpga内部主要结构及其功能分析（Kintex-7FPGA内部结构）

Kintex-7 FPGA的内部结构相比传统FPGA的内部结构嵌入了DSP48E1，PCIE，GTX,XADC,高速IO口等单元，大大提升了FPGA的性能。

2023-08-24 标签：dsp fpga Xilinx 2011 0

FIFO IP核报Memory Collision Error on RAMB36E1解决方案

以前很少用到仿真，这次在仿真的过程中，遇到了某个警告，于是转过头又去研究了FIFO中的Safety Circuit的作用。

2023-06-19 标签：FPGA设计 RAM FIFO存储 1599 0

AXI VIP当作master时如何使用？

AXI接口虽然经常使用，很多同学可能并不清楚Vivado里面也集成了AXI的Verification IP，可以当做AXI的master、pass t...

2023-07-27 标签：仿真器 VCS AXI总线 1588 0

关于EDA工具整合低功耗设计、验证和提高生产力的设计

Cadence Low-Power Solution是用于低功耗芯片的逻辑设计、验证和实现的完全集成的、标准化的流程，将领先的设计、验证和实现技术与Si...

2018-11-13 标签：EDA工具数字信号处理 BRAM 1485 0

基于FPGA BRAM的多端口地址查找表与FPGA BRAM的资源分析

在多端口交换机的设计中，交换机的每个端口都会各自维护一张查找表，数据帧进入到交换机后，需要进行查表和转发。

2024-05-01 标签：FPGA 存储器交换机 1427 0

Xilinx FPGA异步复位同步释放—同步后的复位该当作同步复位还是异步复位？

针对异步复位、同步释放，一直没搞明白在使用同步化以后的复位信号时，到底是使用同步复位还是异步复位？

2023-06-21 标签：寄存器触发器 FDR 1383 0

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