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ic设计——CDC的基本概念

一个系统中往往会存在多个时钟，这些时钟之间有可能是同步的，也有可能是异步的。如果一个系统中，异步时钟之间存在信号通道，则就会存在CDC（clock do...

2019-01-04 标签：IC设计 CDC 1.5万 0

HID+CDC复合设备在WIN10的识别问题

有客户使用STM32F405并参照ST官方USB标准库下的HID+CDC的示例代码做产品，发现在WIN7上使用得好好的，可放到WIN10上，CDC第一次...

2018-05-30 标签：HID CDC WIN10 1.2万 0

介绍USB实现CDC和MSC复合设备的方法

以其中一个工程为模板，将另一个工程中需要的文件拷贝过来。这里以MSC的工程为模板，将CDC工程中的下列文件/文件夹拷贝过来，并添加到工程中。

2023-04-14 标签：msc CDC TF卡 7907 0

cdc路径方案帮您解决跨时钟域难题

这一章介绍一下CDC也就是跨时钟域可能存在的一些问题以及基本的跨时钟域处理方法。跨时钟域的问题主要存在于异步

2017-11-30 标签：CDC 7144 0

XDC路径的鉴别、分析和约束方法

我们知道XDC与UCF的根本区别之一就是对跨时钟域路径（CDC）的缺省认识不同，那么碰到FPGA设计中常见的CDC路径，到底应该怎么约束，在设计上又要注...

2017-11-18 标签：fpga cdc vivado 6289 0

如何调试设计中的时钟域交汇问题

本篇博文中的分析是根据客户真实问题撰写的，该客户发现即使时序已得到满足的情况下，硬件功能仍出现错误。最后发现，问题与时钟域交汇（Clock Domai...

2021-08-20 标签：寄存器 RTL CDC 5404 0

如何让CDC类USB设备批量接收64字节以上数据

很多STM32开发者在实现CDC类虚拟串口与PC主机通信过程中，有时会遇到点麻烦而不得其解。那就是当主机端单次发送的数据不超过64字节时，接收正常。一旦...

2022-10-31 标签：usb STM32 CDC 5343 1

时钟域交叉分析方法

片上系统（SOC）设计的最大挑战之一是不同的块在独立时钟上运行。通过处理器总线，存储器端口，外围总线和其他接口集成这些块可能很麻烦，因为当异步接口未正确...

2019-09-14 标签：处理器 soc cdc 4682 0

跨时钟域CDC之全面解析

在一些较为简单的数字电路中，只有一个时钟，即所有的触发器都使用同一个时钟，那么我们说这个电路中只有一个时钟域。

2023-03-15 标签：寄存器 MTBF 数字电路 3590 0

支持Billboard功能的免驱USB转串口芯片-LDR2001

LDR2001 芯片是乐得瑞科技设计的一个免驱的USB转串口的CDC类芯片，可以实现USB转串口和Billboard的功能。当使用了LDR2001芯片的...

2021-09-10 标签：USB接口 usb 串口 3361 0

什么是同步器？同步器传输数据的情景分析

如图1所示电路结构就叫同步器。左边为时钟域clk1，右边两个FF为时钟域clk2，蓝色的为CDC（clock domain cross）路径。这种电路结...

2023-06-28 标签：寄存器 CDC 同步器 3218 0

Xilinx跨时钟域时序约束

这个命令指定clock之间是异步关系，时序分析时会完全ignore这些clock之间的path。

2022-12-12 标签：Xilinx CDC 时序约束 2457 0

芯片设计之CDC异步电路分析(五)

结构：同一个信号源头，两个同步处理器。这里提一下，有两个CDC分析工具的参数配置：

2024-02-23 标签：处理器芯片设计 CDC 2435 0

基于单片机的USB外设CDC实现

查看EK-RA6M4的原理图，如下图所示，该开发板上的 J11 提供了 Micro USB0接口。

2022-12-19 标签：单片机接口 usb 2216 0

为什么CDC是问题？常用的CDC设计思路

建立时间（tsu) 是在时钟翻转（对于正沿触发寄存器为0→1的翻转）之前数据输入（D）必须有效的时间。

2023-06-27 标签：寄存器 D触发器 CDC 2127 0

一种用于自监督单目深度估计的轻量级CNN和Transformer架构

自监督单目深度估计不需要地面实况训练，近年来受到广泛关注。设计轻量级但有效的模型非常有意义，这样它们就可以部署在边缘设备上。

2023-03-14 标签：RGB 编解码器 CDC 2101 0

CDC跨时钟域处理及相应的时序约束

CDC（Clock Domain Conversion）跨时钟域分单bit和多bit传输

2023-06-21 标签：FPGA设计 RAM CDC 1756 0

数字设计中常见的CDC问题

在数字系统级别的时钟域交叉（CDC）中，亚稳态传播问题是一个重要的挑战。在这个问题中，由于时序差异，信号在触发器之间的传输可能会导致亚稳态值的产生和传播...

2023-08-14 标签：时钟 CDC 触发器 1363 0

FPGA User Guide之report_cdc

report_cdc 可以报告设计中所有的 cdc 路径并将其分类（前提是时钟被约束好），我们可以基于该报告来检查设计中是否有不安全的 cdc 路径。

2022-11-28 标签：fpga CDC REPORT 1182 4

动态时钟的使用

时钟是每个 FPGA 设计的核心。如果我们正确地设计时钟架构、没有 CDC 问题并正确进行约束设计，就可以减少与工具斗争的时间。

2023-07-05 标签：FPGA设计寄存器 CDC 1175 0

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